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VHDL-CPLD 的查询结果
教程资料 使用VHDL编写的频率的精确测量方法的代码
文档中给出了使用VHDL编写的频率的精确测量方法的代码,同时还有cPLD与e2rom等的接口代码
教程资料 CPLD设计实现智能机器小车主要完成寻迹功能等
智能机器小车主要完成寻迹功能，由机械结构和控制单元两个部分组成。机械结构是一个由底盘、前后辅助轮、控制板支架、传感器支架、左右驱动轮、步进电机等组成。控制单元部分主要由主要包含传感器及其调理电路、步进电机及驱动电路、控制器三个部分。本设计的核心为控制器部分，采用Altera MAX7000S系列的EPM7064LC84-15作 ...
教程资料 JTAG CPLD实现源代码
JTAG CPLD实现源代码，比用简单并口调试器快5倍以上。\r\n以前总觉得简单的并口jtag板速度太慢，特别是调试bootloader的时候，简直难以忍受。最近没什么事情，于是补习了几天vhdl，用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是5 ...
可编程逻辑 XAPP380 -利用CoolRunner-II CPLD创建交叉点开关
 
This application note provides a functional description of VHDL source code for a N x N DigitalCrosspoint Switch. The code is designed with eight inputs and eight outputs in order to targetthe 128-macrocell CoolRunner™-II CPLD device but can be easily expanded to target higherdensit ...
可编程逻辑 基于CPLD FPGA的数字通信系统建模与设计
本书主要介绍了基于cpld/fpga的数字通信系统的设计原理与建模方法。从通信系统的组成、eda概述及建模的概念开始（第1～2章），围绕数字通信系统的vhdl设计与建模两条主线，讲述了常用基本电路的建模与vhdl编程设计（第3章），详细地介绍了数字通信基带信号的编译码、复接与分接、同步信号提取、数字通信基带和频带收发信 ...
VHDL/FPGA/Verilog ov7620的CPLD采集程序
ov7620的CPLD采集程序，VHDL语言
VHDL/FPGA/Verilog 我上期做的VHDL设计方案
我上期做的VHDL设计方案，用于在FPGA或CPLD中实现HDB3的编码
VHDL/FPGA/Verilog 极小的CPU的VHDL源代码
极小的CPU的VHDL源代码，仅需要占用32个宏单元的CPLD。除了VHDL源代码还包括了汇编器的C源代码
微处理器开发 JTAG CPLD实现源代码
JTAG CPLD实现源代码，比用简单并口调试器快5倍以上。
以前总觉得简单的并口jtag板速度太慢，特别是调试bootloader的时候，简直难以忍受。最近没什么事情，于是补习了几天vhdl，用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是50秒 ...
VHDL/FPGA/Verilog cpld实现与液晶屏并口通信
cpld实现与液晶屏并口通信，VHDL 语言编程。对VHDL初学者应该有帮助的。