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VHDL SDRAM 的查询结果
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VHDL/FPGA/Verilog 一个航天航空用的Sparc处理器（配美国欧洲宇航局用的R_tems嵌入式操作系统）的VHDL源代码
一个航天航空用的Sparc处理器（配美国欧洲宇航局用的R_tems嵌入式操作系统）的VHDL源代码，但不能保证版图设计ASIC成功
VHDL/FPGA/Verilog 一个8051的VHDL代码
一个8051的VHDL代码，可完整编译，
但不保证版图映射成功，可作为设计微处理器的参考
VHDL/FPGA/Verilog 一个8位RiSC单片机的VHDL代码
一个8位RiSC单片机的VHDL代码，
具有很好的参考价值。
VHDL/FPGA/Verilog 北京里工大学ASIC设计研究所的100个 VHDL程序设计例子
北京里工大学ASIC设计研究所的100个
VHDL程序设计例子
VHDL/FPGA/Verilog 极小的CPU的VHDL源代码
极小的CPU的VHDL源代码，仅需要占用32个宏单元的CPLD。除了VHDL源代码还包括了汇编器的C源代码
VHDL/FPGA/Verilog 用VHDL实现卷积码编码
用VHDL实现卷积码编码，该码为（2.1.3）型卷积码。
其他 这个是带输入的加法器vhdl代码,是带有输入端和进位的.
这个是带输入的加法器vhdl代码,是带有输入端和进位的.
其他 这个是带先行进位的加法器的vhdl代码,比较复杂,仅仅供大家参考.
这个是带先行进位的加法器的vhdl代码,比较复杂,仅仅供大家参考.
其他 这个是用vhdl编写的乘法器,仅仅供大家参考
这个是用vhdl编写的乘法器,仅仅供大家参考
其他 这个是用vhdl语言编写的除法器,仅仅供大家参考.
这个是用vhdl语言编写的除法器,仅仅供大家参考.