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VHDL SDRAM 的查询结果
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VHDL/FPGA/Verilog flash接口控制器的VHDL以及verilog源代码和Testbench程序
flash接口控制器的VHDL以及verilog源代码和Testbench程序
VHDL/FPGA/Verilog EDA中常用模块VHDL程序
EDA中常用模块VHDL程序，不同时基的计数器由同一个外部是中输入时必备的分频函数。分频器FENPIN1/2/3(50分频=1HZ，25分频=2HZ，10分频=5HZ。稍微改变程序即可实现)
VHDL/FPGA/Verilog EDA常用计数函数VHDL程序设计
EDA常用计数函数VHDL程序设计，减法计数器：可预置数：
VHDL/FPGA/Verilog I2C控制核设计,由VHDL语言编写,使普通I/O端口实现I2C性能
I2C控制核设计,由VHDL语言编写,使普通I/O端口实现I2C性能
VHDL/FPGA/Verilog VHDL实现ALU的源代码
VHDL实现ALU的源代码，并且提供了一个详细的testbench！
其他 用VHDL语言编写的三人表决器
用VHDL语言编写的三人表决器，多数服从少数，或者一致通过。
VHDL/FPGA/Verilog 用FPGA实现SDRAM的操作
用FPGA实现SDRAM的操作，具体操作见内部说明文件
VHDL/FPGA/Verilog 用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
VHDL/FPGA/Verilog 用VHDL语言实现的ARM处理器的标准内核的源代码程序
用VHDL语言实现的ARM处理器的标准内核的源代码程序，可在重用
电子书籍 vhdl语言编程软件应用于学习教程。适合于初学者进行vhdl语言的学习。
vhdl语言编程软件应用于学习教程。适合于初学者进行vhdl语言的学习。