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学术论文  10100M以太网芯片的I2C接口模块的FPGA设计

该文结合"10M/100M以太网交换芯片的设计"课题,介绍了以太网技术发展的概况和IP CORE、SoC的设计方法,阐述了以太网交换原理及关键技术,研究了CSMA/CD协议、交换机、VLAN的原理和数据流优先技术及流量控制,在此基础上完成了10M/100M以太网交换芯片的主要模块的设计方案和实现框图.同时结合Philip公司的IC总线的工作原理,给出 ...

https://www.eeworm.com/dl/514/11423.html

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学术论文  高清视频编解码系统控制模块设计

在航空航天，遥感测量，安全防卫以及家用影视娱乐等领域，要求能及时保存高清晰度的视频信号供后期分析、处理、研究和欣赏。因此，研究一套处理速度快，性能可靠，使用方便，符合行业相关规范的高清视频编解码系统是十分必要的。本文首先介绍了高清视频的发展历史。并就当前相关领域的发展阐述了高清视频编解码系统的设计 ...

https://www.eeworm.com/dl/514/12484.html

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学术论文  基于FPGA的MCS51核的VHDL语言

本文以研究嵌入式微处理器为主，自主地设计了能够运行MCS-51系列单片机指令的MCU系统。系统采用了VHDL 语言与原理框图的综合设计方法，并且在Altera公司的FPGA上通过验证。论文深入地研究了微处理器的指令系统和数据地址通路，采用VHDL 语言完成了取指单元，指令译码器单元，存储器单元和逻辑运算单元的电路模块的设计与实 ...

https://www.eeworm.com/dl/514/12701.html

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教程资料  分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点

分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点，\\r\\n然后结合FSK 信号的产生原理，给出了如何利用DSP Builder 模块库建立FSK 信号发生器模\\r\\n型，以及对FSK 信号发生器模型进行算法级仿真和生成VHDL 语言的方法，并在modelsim\\r\\n中对FSK 信号发生器进行RTL 级仿真，最后介绍了在FPGA 芯片中实现FSK ...

https://www.eeworm.com/dl/fpga/doc/18138.html

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教程资料  数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述

数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。\r\n

https://www.eeworm.com/dl/fpga/doc/18672.html

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单片机编程  基于VHDL的微型打印机控制器设计

介绍基于VHDL的微型打印机控制器的设计。论述了微型打印机的基本原理，以及实现控制器的VHDL语言设计。打印机的数据来自系统中的存储模块，根据需要控制打印。该微型打印机控制器可取代传统的微型打印机,且抗干扰性好,可靠性高，具有较强的移植性，稍加改动就可应用于不同场合。 Abstract: &nbsp;This paper introduced ...

https://www.eeworm.com/dl/502/29204.html

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可编程逻辑  基于CPLD的VHDL语言数字钟(含秒表)设计

利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。本设计采用自顶向下、混合输入方式（原理图输入&mdash;顶层文件连接和VH ...

https://www.eeworm.com/dl/kbcluoji/40186.html

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VHDL/FPGA/Verilog 乘法器是硬件设计中的很常见也很重要的一个模块

乘法器是硬件设计中的很常见也很重要的一个模块，它的VHDL硬件实现很好的解决了软件编程中做乘法速度慢的问题，在实时高速系统应用中或DSP软核或数字信号处理硬件实现算法中，经常能使用到乘法器，所以经典的高速乘法器IP 很有参考价值 ...

https://www.eeworm.com/dl/663/130064.html

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VHDL/FPGA/Verilog 数字通信系统通信系统调制解调（PL_FSK）VHDL建模

数字通信系统通信系统调制解调（PL_FSK）VHDL建模，包括发送和接受模块

https://www.eeworm.com/dl/663/153769.html

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VHDL/FPGA/Verilog 数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述

数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。

https://www.eeworm.com/dl/663/156138.html

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