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VGA时序 的查询结果
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VHDL/FPGA/Verilog 这个是VGA的核是NOIS开发时使用的IP CORES 在FPGA的开发中使用的比较多
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Linux/Unix编程 vivi bootload 可以使用支持vga tv
vivi bootload 可以使用支持vga tv
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标与VGA控制模块
基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标与VGA控制模块
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的VGA彩条信号显示控制器
基于fpga和sopc的用VHDL语言编写的EDA的VGA彩条信号显示控制器
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的VGA图像显示控制器
基于fpga和sopc的用VHDL语言编写的EDA的VGA图像显示控制器
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的PS/2和VGA控制显示控制器
基于fpga和sopc的用VHDL语言编写的EDA的PS/2和VGA控制显示控制器
微处理器开发 ads下的 s3c2440a 简单的vga 源代码！是学习ARM9的最简工程！
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单片机开发 使用单片机模拟I2C时序对24c02进行读写,通过proteus仿真对数据进行分析. 有仿真图片
使用单片机模拟I2C时序对24c02进行读写,通过proteus仿真对数据进行分析.
有仿真图片
其他 altera fpga 基于vhdl,实现vga的同步block.
altera fpga 基于vhdl,实现vga的同步block.
压缩解压 利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试
利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。
本设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VHDL语言输 ...