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VERILOG-HDL 的查询结果
教程资料 FPGA Verilog
FPGA Verilog,双向端口的研究,比较全,由ASSIGN和ALWAYS模块组成,测试可用
教程资料 jepg verilog example
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教程资料 这是一个关于晶震的一个verilog 源代码,希望对新手有用
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教程资料 arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核
arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核，对学习arm和FPGA开发有帮助。
教程资料 这是我写的一个关于fpga verilog的程序希望有对初学着有帮助
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教程资料 fpga-jpeg-verilog在fpga平台使用verilog语言进行jpeg算法实现
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教程资料 Verilog实现的DDS正弦信号发生器和测频测相模块
Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。
教程资料 dds设计，生成多种波形，Verilog语言
dds设计，花了一个星期做的,verilog写的，可生成多种波形，频率范围可上M,性能不错。
教程资料 用Verilog实现基于FPGA的通用分频器
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教程资料 verilog 编写的I2c协议程序
verilog 编写的I2c协议程序，用于cpld读写EEPROM