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VERILOG-HDL 的查询结果
VHDL/FPGA/Verilog 60秒秒表设计
60秒秒表设计，可暂停和分段计数等，所有功能是利用verilog HDL来描述，最后下载到CPLD/FPGA才能运行。
VHDL/FPGA/Verilog 本例是关于卷积码的一个简单算法
本例是关于卷积码的一个简单算法，用verilog HDL语言编写，整个文档包括了产生卷积的整个工程。
VHDL/FPGA/Verilog FIFO 源程序
FIFO 源程序，verilog HDL实现，自己验证过，没问题
VHDL/FPGA/Verilog 设计带进位算术逻辑运算单元
设计带进位算术逻辑运算单元，根据74LS181功能表，用Verilog HDL硬件描述语言编程实现ALU181的算术逻辑运算功能，编辑实验原理图，在算术逻辑单元原理图上，将其扩展为带进位的算术逻辑运算单元，对其进行编译，并设计波形对其进行仿真验证，最后下载验证 ...
其他嵌入式/单片机内容 i2c总线模拟
i2c总线模拟，verilog hdl编写的总线模拟控制程序
Linux/Unix编程 对vga接口做了详细的介绍
对vga接口做了详细的介绍，并且有一
·三段式Verilog的IDE程序，但只有DMA
·电子密码锁，基于fpga实现，密码正
·IIR、FIR、FFT各模块程序设计例程，
·基于逻辑工具的以太网开发，基于逻
·自己写的一个测温元件（ds18b20）的
·光纤通信中的SDH数据帧解析及提取的
·VHDL Programming by Example（McGr
·这是CAN总线控 ...
其他 输入输出控制的状态机
输入输出控制的状态机，verilog HDL源码
VHDL/FPGA/Verilog ps2接口控制程序
ps2接口控制程序，采用verilog hdl
嵌入式/单片机编程 PS2键盘鼠标接口控制实现电子琴功能
PS2键盘鼠标接口控制实现电子琴功能，verilog hdl 编写