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VHDL/FPGA/Verilog altera i2c slave ip核verilog 编写
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嵌入式/单片机编程 This an exercise in using finite state machines.基于ALTERA的DE2开发 平台
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平台，设计一个有限状态机FSM(finite state machines).
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分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单 ...
VHDL/FPGA/Verilog altera公司max2系列开发板原理图
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VHDL/FPGA/Verilog 在ALTERA公司的EPM570上实现的电机脉冲算法
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