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开发工具 Altera ModelSim 6.5仿真入门教程

    Altera ModelSim 6.5仿真入门教程,需要的可自行下载。   平台   软件:ModelSim-Altera 6.5e (Quartus II 10.0) Starter Edition   内容   1 设计流程   使用ModelSim仿真的基本流程为:         图1.1 使用 ModelSim仿真的基本流程   2 开始 ...
https://www.eeworm.com/dl/550/37730.html
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仿真技术 Altera ModelSim 6.5仿真入门教程

    Altera ModelSim 6.5仿真入门教程,需要的可自行下载。   平台   软件:ModelSim-Altera 6.5e (Quartus II 10.0) Starter Edition   内容   1 设计流程   使用ModelSim仿真的基本流程为:         图1.1 使用 ModelSim仿真的基本流程   2 开始 ...
https://www.eeworm.com/dl/524/42507.html
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单片机开发 HG1926419C驱动程序源代码 主要应用于单片机

HG1926419C驱动程序源代码 主要应用于单片机,稍加修改后可应用于其他的操作系统,如:uCos-II,linux等
https://www.eeworm.com/dl/648/415551.html
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VHDL/FPGA/Verilog de2板上的led显示程序

de2板上的led显示程序,最简单的nios测试程序,可以实现de2板上的两个小灯的闪烁,用quatus ii定置sopc系统!
https://www.eeworm.com/dl/663/492661.html
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技术资料 STM32奋斗版ucOSIIV2.86_uCGUI3.9_DEMO

STM32奋斗版ucOS II V2.86 uCGUI 3.9 DEMO 基于STM32奋斗版V3的板子,学习STM32绝佳资料,实际验证过,可以使用
https://www.eeworm.com/dl/986944.html
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技术资料 在LPC1788上移植ucos

在LPC1788上成功移植uc/OS-II,构建最小系统即可稳定运行,支持串口调试查看任务状态,适用于嵌入式实时系统开发与验证
https://www.eeworm.com/dl/1000132.html
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技术资料 FPGA的数字时钟的设计

该文档为基于FPGA的数字时钟的设计讲解文档,在QuartusⅡ开发环境下,用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字 时钟.通过将设计代码下载到FPGA的开发平台Ahera DE2开发板上进行了功能验证.由于数字时钟的通用性 及Verilog HDL语言的可移植性,冈此本数字时钟可直接应用于各种不同系列的FPGA芯片的 ...
https://www.eeworm.com/dl/845524.html
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VHDL/FPGA/Verilog 这是一个基于FPGA/SOPC设计的简单串口程序

这是一个基于FPGA/SOPC设计的简单串口程序,是FPGA硬件和niosII软件编程的结合。对初学者有很大的借鉴意义。在Quartus6.1和niosII6.1环境下编译通过,并且下载到板子上运行成功
https://www.eeworm.com/dl/663/479532.html
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其他 基于FPGA的信号采集及频谱分析

基于FPGA的信号采集及频谱分析,用VHDL编写,压缩包里是Quartus下的工程。AD采样用状态机实现,并存入LPM_RAM。设计了一个UART模块(也是状态机实现的),可将数据发到PC机上。
https://www.eeworm.com/dl/534/493788.html
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VHDL/FPGA/Verilog 一个实现简单的数字锁相环Verilog代码

一个实现简单的数字锁相环Verilog代码,本人借鉴网上现有的代码后经修改在Cyclone II上调通实现,里面有ModelSim仿真成功的波形图
https://www.eeworm.com/dl/663/276511.html
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