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VHDL/FPGA/Verilog 光栅尺的四细分和辩向电路

光栅尺的四细分和辩向电路，并具有计数器功能，利用Quartus综合，可以参考

https://www.eeworm.com/dl/663/224286.html

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VHDL/FPGA/Verilog 标准电视信号的同步生成程序

标准电视信号的同步生成程序，利用VHDL和原理图，利用Quartus综合

https://www.eeworm.com/dl/663/224287.html

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VHDL/FPGA/Verilog This leon3 design is tailored to the Altera NiosII Startix2 Development board, with 16-bit DDR SDR

This leon3 design is tailored to the Altera NiosII Startix2 Development board, with 16-bit DDR SDRAM and 2 Mbyte of SSRAM. As of this time, the DDR interface only works up to 120 MHz. At 130, DDR data can be read but not written. NOTE: the test bench cannot be simulated with DDR enabled because ...

https://www.eeworm.com/dl/663/226442.html

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书籍源码  ASK调制程序基于VHDL

ASK调制程序基于VHDL，应用于QUARTUS ,不妨下载

https://www.eeworm.com/dl/532/233198.html

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VHDL/FPGA/Verilog 这是一个fft的IP核

这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。

https://www.eeworm.com/dl/663/233510.html

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嵌入式/单片机编程  SD卡和AIC23数字音频输出实验, FreeDev Audio Dsp Board采用了TI公司的TVL320AIC23 1、控制接口使用I2C

SD卡和AIC23数字音频输出实验, FreeDev Audio Dsp Board采用了TI公司的TVL320AIC23 1、控制接口使用I2C，Quartus中将CS置低（器件地址0011010）。 2、数字音频接口使用了组件FreeDev_aic23,有三种测试和应用模式，中断结合DMA方式能在NIOS II中采集和发送数据。中断信号产生于模块中FIFO缓冲区的半满信号，读取数据端口 ...

https://www.eeworm.com/dl/647/233960.html

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其他嵌入式/单片机内容  简易数字频率计

简易数字频率计，用Verilog HDL编写的，基于Quartus II实现，结构清晰，功能较为全面，能满足简单的频率测量要求

https://www.eeworm.com/dl/687/244601.html

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VHDL/FPGA/Verilog 本程序对如何使用altera系列芯片片上ram进行实例演示

本程序对如何使用altera系列芯片片上ram进行实例演示，采用Verilog HDL语言编写，并使用modelsim与quartus联合进行功能仿真。本原码是红色逻辑开发板的试验程序，值得一看。

https://www.eeworm.com/dl/663/247464.html

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文章/文档  简易示波器的VHDL程序

简易示波器的VHDL程序，可以应用，开发环境QUARTUS,实验箱为GW48

https://www.eeworm.com/dl/652/250281.html

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文章/文档  用VHDL演示MUSIC的程序

用VHDL演示MUSIC的程序，可以应用，开发环境QUARTUS,实验箱为GW48

https://www.eeworm.com/dl/652/250282.html

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