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通讯/手机编程 Ph.D thesis from M.H.Perrott, about Fractional-N PLL design.
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电子书籍 PhD.thesis about fractional PLL design from UC san-deago.
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其他 LPC23xx系列ARM时钟源的选择、PLL的设置步骤以及注意事项等。PPT做的非常出色。
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中间件编程 pll 的64倍频 锁相环技术用 实现倍频 从而达到对频率的分频
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VHDL/FPGA/Verilog 驱动时钟加入了PLL,使得DDS的驱动时钟可变.32位的NCO使得DDS的分辨率可以做到Hz量级
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编译器/解释器 PLL芯片ATF4154控制程序
PLL芯片ATF4154控制程序，单片机，51，调试通过了的，可以使用
VHDL/FPGA/Verilog verilog PLL的代码
verilog PLL的代码，和PLL 的功能介绍，希望能通过，只是简单了点
GPS编程 该程序包含一般数字PLL仿真maltab程序和数字COSTAS环程序
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