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VHDL/FPGA/Verilog 帧同步检测源码
帧同步检测源码，包括同步跟踪模块，fifo,分频模块，还有系统的测试平台
其他行业 clustalw1.83.DOS.ZIP,用于多序列比对的软件
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DDR RAM控制器的VHDL源码，实现平台是Lattice FPGA，功能验证通过
Windows CE WINCE下的游戏开发
WINCE下的游戏开发，用EVC 在 POCKET 平台下用ARM10运行
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ucos下完成时钟显示及别的任务，编程平台为SDT2.51，c代码
其他嵌入式/单片机内容 SST flash driver,已经经过测试
SST flash driver,已经经过测试，无需修改源码，只需根据不同平台调整延时即可。