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NC-Verilog 的查询结果
VHDL/FPGA/Verilog 一个可综合的同步FIFO的verilog源代码
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VHDL/FPGA/Verilog 此程序为串行通信程序,采用verilog语言编写的,经过仿真验证已经通过.
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VHDL/FPGA/Verilog 里面含有vhdl和verilog 版本,很好用!dct变换用得很多啊!
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其他嵌入式/单片机内容 该代码中有不少关于学习verilog HDL的例子,对初学者有帮助
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VHDL/FPGA/Verilog JTAG design verilog code.
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其他嵌入式/单片机内容 这里有verilog编写的8051ipcore 谁要啊?
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VHDL/FPGA/Verilog verilog分频器～时钟为50hmz
verilog分频器～时钟为50hmz，波特率采用9600bps～
VHDL/FPGA/Verilog Hynix公司8M byte sdr sdram的verilog语言仿真实现。
Hynix公司8M byte sdr sdram的verilog语言仿真实现。
其他书籍 北航夏宇闻的关于verilog的经典教材
北航夏宇闻的关于verilog的经典教材，想学习verilog的人，可以下载学习一下，还是比较系统的好教材。
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Verilog HDL课件，有常见问题说明