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VHDL/FPGA/Verilog 关于序列发生器的verilog. 希望能帮大家。
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希望能帮大家。
VHDL/FPGA/Verilog CRC循环校验码的VERILOG源文件
CRC循环校验码的VERILOG源文件，在MODELSIM下的一个工程。
VHDL/FPGA/Verilog 奇偶校验码的VERILOG源码
奇偶校验码的VERILOG源码，为MODELSIM下的一个工程。有测试文件。
VHDL/FPGA/Verilog 各种基本单元的verilog模块.对初学者很有帮助的.
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其他书籍 中文版Verilog HDL简明教程 第1章 简介 第2章 HDL指南 第3章 Verilog语言要素 第4章 表 达 式 第5章 门电平模型化
中文版Verilog HDL简明教程
第1章 简介
第2章 HDL指南
第3章 Verilog语言要素
第4章 表 达 式
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VHDL/FPGA/Verilog 用Verilog HDL 语言编写的播放梁祝的程序
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VHDL/FPGA/Verilog 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的
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VHDL/FPGA/Verilog Verilog在maxpuls2下开发的电梯控制器的文档（包括代码）
Verilog在maxpuls2下开发的电梯控制器的文档（包括代码），其中说明十分详尽
其他 这是一个rs译码器的verilog程序运行于quatus
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VHDL/FPGA/Verilog 这个是用VERILOG做的一个8位功能很弱的CPU
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