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ModelSim-altera 的查询结果
技术资料 FPGA那些事儿--Modelsim仿真技经典学习开发设计经验书籍
FPGA那些事儿--Modelsim仿真技巧REV6.0，经典Modelsim学习开发设计经验书籍-331页。前言笔者一直以来都在纠结，自己是否要为仿真编辑相关的教程呢？一般而言，Modelsim 等价仿真已经成为大众的常识，但是学习仿真是否学习Modelsim，笔者则是一直保持保留的态度。笔者认为，仿真是Modelsim，但是Modelsim 不是仿真，严格来讲 ...
技术资料 Altera(Intel)_MAX10_10M02SCU169开发板资料硬件参考设计+逻辑例程
Altera(Intel)_MAX10_10M02SCU169开发板资料硬件参考设计+逻辑例程.QM_MAX10_10M02SCU169开发板主要特征参数如下所示： 主控CPLD：10M02SCU169C8G； 主控CPLD外部时钟源频率：50MHz； 10M02SCU169C8G芯片内部自带丰富的Block RAM资源； 10M02SCU169C8G芯片逻辑单元数为2K LE； QM_MAX10_10M02SCU169开发板板载Sil ...
技术资料 Altera(Intel)_Cyclone10_10CL006开发板资料硬件参考设计+逻辑例程
Altera(Intel)_Cyclone10_10CL006开发板资料硬件参考设计+逻辑例程。QM_Cyclone10_10CL006开发板主要特征参数如下所示： 主控FPGA：10CL006YU256C8G； 主控FPGA外部时钟源频率：50MHz； 10CL006YU256C8G芯片内部自带丰富的Block RAM资源； 10CL006YU256C8G芯片逻辑单元数为6K LE； QM_Cyclone10_10CL006开发板板 ...
技术资料 Altera(Intel)_Cyclone_IV_EP4CE15_开发板资料硬件参考设计+逻辑例程
Altera(Intel)_Cyclone_IV_EP4CE15_开发板资料硬件参考设计+逻辑例程Cyclone IV EP4CE15核心板主要特征参数如下所示：➢ 主控FPGA：EP4CE15F23C8N；➢ 主控FPGA外部时钟源频率：50MHz；➢ EP4CE15F23C8N芯片内部自带丰富的Block RAM资源；➢ EP4CE15F23C8N芯片逻辑单元数为15K LE；➢ Cyclone IV EP4CE15板载W25Q064 SPI Fl ...
技术资料 USB in 模型作为输入包括基于Altera的工程源码固件使用Verilog
USB in 模型，作为输入，包括基于Altera的工程、源码、固件，使用Verilog
技术资料 ALTERA关于CCD的一些verilog实验程序
ALTERA关于CCD的一些verilog实验程序，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈
技术资料 FPGA那些事儿--Modelsim仿真技巧
FPGA那些事儿--Modelsim仿真技巧REV1.0
技术资料 基于Altera的FPGA设计的硬件除法器
基于Altera的FPGA设计的硬件除法器，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈
技术资料 （网盘）关于FPGA的Quartus,ModelSim等安装介绍和使用等基本操作
想学习FPGA的小白，可以看下这个，包括Quartus的安装，ModelSim安装，以及入门操作，另外还配有板子芯片的介绍，可以初步认识学习FPGA
技术资料 数字信号处理的FPGA实现中文版 刘凌
FPGA正在掀起一场数字信号处理的变革。本书旨在讲解前端数字信号处理算法的高效实现。首先概述了当前的FPGA技术、器件以及用于设计最先进DSP系统的工具。第1章的案例研究是40多个设计示例的基础。随后几章阐述了计算机算法的概念、理论、FIR和IIR滤波器的实现、多抽样率数字信号系统、DFT和FFT算法、未来很可能实现的高级算 ...