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找到约 804 项符合
ModelSim 的查询结果
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技术资料 基于FPGA频率计设计
本文主要介绍了基于FPGA 的简易多量程频率计的设计，使用硬件描述语言verilog来实现对硬件的控制，在软件ISE上实现编程的编译综合，在系统时钟48Mhz下可正常工作。该数字频率计采用测频的方法，能准确的测量频率在10Hz到100MHz之间的信号。使用ModelSim仿真软件对Verilog程序做了仿真，并完成了综合布局布线，通过ISE下载到 ...
单片机编程 基于Avalon总线的8051MCU IP核的设计
设计了一款基于Avalon总线的8051MCU IP核。它支持MCS-51指令集，优化内部的结构，通过采用流水线技术、指令映射技术、指令预取技术、微代码技术等极大的提高了IP核的工作速度，使IP核在100MHz时钟下，能够单周期执行一条指令。本设计使用Modelsim软件完成了功能仿真和时序仿真，并在以Altera 公司的Cyclone II FPGA芯片为核 ...
VHDL/FPGA/Verilog 本代码介绍了使用VHDL开发FPGA的一般流程
本代码介绍了使用VHDL开发FPGA的一般流程，最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL，在软件开发平台ISE上完成，可以在较高速时钟频率（100MHz）下正常工作。该设计的频率计能准确的测量频率在1Hz到100MHz之间的信号。使用ModelSim仿真软件对VHDL程序做了仿真，并完成了综合布局布线，最终 ...
其他书籍 目 录 第 一 节ispDesignEXPERT 简 介 第 二 节ispDesignEXPERT System 的 原 理 图 输 入 第 三 节设 计 的 编 译 与 仿 真 第 四 节A
目 录
第 一 节ispDesignEXPERT 简 介
第 二 节ispDesignEXPERT System 的 原 理 图 输 入
第 三 节设 计 的 编 译 与 仿 真
第 四 节ABEL 语 言 和 原 理 图 混 合 输 入
第 五 节ispDesignEXPERT System 中 VHDL 和Verilog 语 言 的 设 计 方 法
第 六 节 在 系 统 编 程 的 操 作 方 法
第 七 节ModelSim 的 使 用 方 法 ...
VHDL/FPGA/Verilog :传统的交通灯控制器多数由单片机或PLC来实现,文中介绍了基于VHDL硬件描述语言进行交通灯控制 器设计的一般思路和方法。选择XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5.
:传统的交通灯控制器多数由单片机或PLC来实现,文中介绍了基于VHDL硬件描述语言进行交通灯控制
器设计的一般思路和方法。选择XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5. X和MODELSIM
SE 6. 0开发工具进行了程序的编译和功能仿真。最后给出了交通灯控制器的部分VHDL源程序和仿真结果,仿
真结果表明该系统的设计 ...
技术资料 Verilog经典教程.pdf
本书读者如果配合一套可在PC586 平台上运行的Verilog HDL 仿真和综合工具，如
QuickLogic 公司的Spade 的教学软件包(Verilog HDL 版)、Mentor 公司的Modelsim 等开发环境下，只要带Verilog HDL 仿真器(如Verilog-XL)和综合器（如Synplify），就可以
运行本书所有的Verilog HDL 程序，可在这一环境下通过做各种仿真和综合的 ...
技术资料 HDL Designer Series 2010.2a win32
ASIC、FPGA和系统单芯片设计工具"Mentor Graphics HDL Designer 工具套件，为客户带来生产力更高的设计输入、分析与管理功能，包括更强大的联机资料表格，无论设计复杂性如何，都能迅速建立高品质且结构良好的硬件描述语言。HDL Designer Series可协助工程师迅速输入和分析复杂的ASIC、FPGA和系统单芯片设计，让客户新产品 ...
教程资料 FPGA开发光盘各章节实例的设计工程与源码
附录 光盘说明\r\n本书附赠的光盘包括各章节实例的设计工程与源码，所有工程在下列软件环境下运行通过：\r\n? Windows XP SP2\r\n? MATLAB\r\n? Altera Quartus II \r\n? synplify8.4\r\n? modelsim_ae6.1\r\n\r\n光盘目录与实例名称的对应关系如下：\r\n\r\n cht02文件夹中存放的是书中第2章中的例子，读者可 ...
单片机编程 怎样写testbench-xilinx
怎样写testbench-xilinx
 在ISE 环境中， 当前资源操作窗显示了资源管理窗口中选中的资源文件能进行的相关操作。在资源管理窗口选中了 testbench 文件后，在当前资源操作窗显示的 ModelSim Simulator 中显示了4种能进行的模拟操作，分别是：Simulator Behavioral Model（功能仿真）、Simulator Post-translate VHDL Mo ...
VHDL/FPGA/Verilog 本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程
本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程，作为我这一段
时间自学 FPGA/CPLD 的总结，如果有什么不正确的地方，敬请各位不幸看到这篇文章的
大侠们指正，在此表示感谢。当然，这是一个非常简单的时序逻辑电路实例，主要是详细
描述了一些软件的使用方法。文章中涉及的软件有Synplicity 公司出品的Syn ...