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https://www.eeworm.com/dl/663/298710.html
VHDL/FPGA/Verilog
FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE 第一章 Modelsim编译Xilinx库 第二章 调用Xilinx CORE-Generato
FPGA设计全流程：Modelsim>>Synplify.Pro>>ISE
第一章 Modelsim编译Xilinx库
第二章 调用Xilinx CORE-Generator
第三章 使用Synplify.Pro综合HDL和内核
第四章 综合后的项目执行
第五章 不同类型结构的仿真
https://www.eeworm.com/dl/686/419749.html
VC书籍
Visual C++教程[ppt课件].运行环境：Win9X/2000/XP/2003/ 软件语言：简体中文 软件类型：教程书籍 - 电子书籍 - VC教程
Visual C++教程[ppt课件].运行环境：Win9X/2000/XP/2003/
软件语言：简体中文
软件类型：教程书籍 - 电子书籍 - VC教程