搜索：IP软核
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https://www.eeworm.com/dl/687/294985.html
其他嵌入式/单片机内容
NoisII软核在Nois IDE编译时遇到的问题的总结
NoisII软核在Nois IDE编译时遇到的问题的总结，有兴趣的朋友可以下去
https://www.eeworm.com/dl/647/320636.html
嵌入式/单片机编程
用c语言写的niosii软核的多种外设测试程序
用c语言写的niosii软核的多种外设测试程序，实用
https://www.eeworm.com/dl/647/357314.html
嵌入式/单片机编程
基于Altera fpga 的软核 nios2的串口调试代码
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https://www.eeworm.com/dl/647/429945.html
嵌入式/单片机编程
基于alterafpga的niosii软核的源程序和好调试过的
基于alterafpga的niosii软核的源程序和好调试过的
https://www.eeworm.com/dl/900891.html
技术资料
采用软处理器IP规避器件过时的挑战
在向一个嵌入式产品设计做出几年的财力和物力投资之后，你最不愿意听到的消息就是你所采用的器件已经“生命终止”。在分立的嵌入式处理中，陈旧过时意味着你必须为你的下一个设计转向采用另外一种处理器，并且完全可 ...
https://www.eeworm.com/dl/514/12423.html
学术论文
基于FPGA的GPIB控制器的IP核设计
当前，片上系统(SOC)已成为系统实现的主流技术。流片风险与费用增加、上市时间压力加大、产品功能愈加复杂等因素使得SOC产业逐渐划分为IP提供者、SOC设计服务者和芯片集成者三个层次。SOC设计已走向基于IP集成的平台设计阶段，经过严格验证质量可靠的IP核成为SOC产业中的重要一环。 GPIB控制器芯片是组 ...
https://www.eeworm.com/dl/571/20874.html
模拟电子
单端10-bit SAR ADC IP核的设计
本设计通过采用分割电容阵列对DAC进行优化，在减小了D/A转换开关消耗的能量、提高速度的基础上，实现了一款采样速度为1 MS/s的10-bit单端逐次逼近型模数转换器。使用cadence spectre 工具进行仿真，仿真结果表明，设计的D/A转换器和比较器等电路满足10-bit A/D 转换的要求，逐次逼近A/D转换器可以正常 ...
https://www.eeworm.com/dl/502/29481.html
单片机编程
基于Avalon总线的8051MCU IP核的设计
设计了一款基于Avalon总线的8051MCU IP核。它支持MCS-51指令集，优化内部的结构，通过采用流水线技术、指令映射技术、指令预取技术、微代码技术等极大的提高了IP核的工作速度，使IP核在100MHz时钟下，能够单周期执行一条指令。本设计使用Modelsim软件完成了功能仿真和时序仿真，并在以Altera 公司的Cyc ...
https://www.eeworm.com/dl/510/36358.html
无线通信
基于SOPC技术的异步串行通信IP核的设计
介绍了SoPC（System on a Programmable Chip）系统的概念和特点，给出了基于PLB总线的异步串行通信（UART）IP核的硬件设计和实现。通过将设计好的UART IP核集成到SoPC系统中加以验证，证明了所设计的UART IP核可以正常工作。该设计方案为其他基于SoPC系统IP核的开发提供了一定的参考。
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