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matlab例程 介绍了一种将Matlab编译成可执行程序的一种方法
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VHDL/FPGA/Verilog 该源码为几个正弦ROM,已经编译并通过,可以直接下载,不需要,内部含有正弦ROM表,还有ROM的宏模块
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VHDL/FPGA/Verilog 这是我在学习过程中编的数字钟的原程序,含各种时钟模块,以及计数器,累加器等,可以直接下载,已经编译通过!
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