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G.729A 的查询结果
VHDL/FPGA/Verilog 一个四位二进制加/减运算器。 要求：当控制端G＝0时做加运算
一个四位二进制加/减运算器。
要求：当控制端G＝0时做加运算，G＝1时做减运算。用发光二极管表示运算结果的正、负。用数码管显示运算结果：加运算时，相加之和不超过15，减运算时，结果可正可负，但都用原码表示。
语音压缩 Definition of G.711 standard
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语音压缩 Appendix I to G.711 standard
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多国语言处理 记录我针对数字通信（John.G Proakis）版本学习中编写的仿真程序。 和大家交流共同学习
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和大家交流共同学习，其中的错误，希望大家指证！