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VHDL/FPGA/Verilog fifo pointers in verilog gray code utilization for synchronius
fifo pointers in verilog gray code utilization for synchronius
VHDL/FPGA/Verilog 用vhdl设计的一个FIFO存储器
用vhdl设计的一个FIFO存储器
VHDL/FPGA/Verilog 异步FIFO的FPGA实现,XILINX FPGA, ISE ,VHDL语言实现
异步FIFO的FPGA实现,XILINX FPGA,
ISE ,VHDL语言实现
VHDL/FPGA/Verilog 利用sram技术设计的一个FIFO
利用sram技术设计的一个FIFO
VHDL/FPGA/Verilog 16×4bit的FIFO设计代码
16×4bit的FIFO设计代码，学习代码，请在下载24小时后删除。
手册 altera单时钟和双时钟fifo IP核用户向导
altera单时钟和双时钟fifo IP核用户向导，描述了该IP核各个输入和输出端口的含义以及使用方法和注意事项
源码 异步fifo设计参考
拜读了Clifford E. Cummings大神的关于fifo的文章有感，感觉其设计的fifo算法很好，特拿出来分享
技术资料 verilog FIFO PPT
FIFO先进先出原理图解，及两个模型的源代码。
技术资料 基于FPGA异步FIFO的研究与实现
该文档为基于FPGA异步FIFO的研究与实现简介文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………
技术资料 FPGA片内FIFO读写测试Verilog逻辑源码Quartus工程文件+文档说明 使用 FPGA
FPGA片内FIFO读写测试Verilog逻辑源码Quartus工程文件+文档说明，使用 FPGA 内部的 FIFO 以及程序对该 FIFO 的数据读写操作。FPGA型号Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。timescale 1ns / 1ps//////////////////////////////////////////////////////////////////////////////////module fifo_test( input c ...