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操作系统开发 操作系统实验 页面置换 fifo LRU 最优页面调度算法opT
操作系统实验 页面置换 fifo LRU 最优页面调度算法opT
VHDL/FPGA/Verilog 一个用VHDL源码编写的先进先出(FIFO)缓冲器模块.可以进行FIFO的仿真验证
一个用VHDL源码编写的先进先出(FIFO)缓冲器模块.可以进行FIFO的仿真验证
VHDL/FPGA/Verilog 另外一个用VHDL源码编写的FIFO模块程序,可以比较一下和FIFO有什么区别.
另外一个用VHDL源码编写的FIFO模块程序,可以比较一下和FIFO有什么区别.
通讯编程文档 fifo vhdl源码
fifo vhdl源码，高可靠性，带有格雷码同步，有需要可依进行参考！
单片机开发 EZ-USB的CY7C68013A实现Slave FIFO的AutoIN。关键配置见TD_Init函数。
EZ-USB的CY7C68013A实现Slave FIFO的AutoIN。关键配置见TD_Init函数。
VHDL/FPGA/Verilog VERILOG Synchronous FIFO. 4 x 16 bit words.
VERILOG
Synchronous FIFO. 4 x 16 bit words.
单片机开发 USB 2.0 FIFO 工作模式 C语言编程 CY7C68013单片机
USB 2.0 FIFO 工作模式 C语言编程 CY7C68013单片机
VHDL/FPGA/Verilog FIFO和计数器以及时钟控制
FIFO和计数器以及时钟控制，用于程控交换机教学，与DSP和ADDA芯片配合完成程控交换机功能
书籍源码 fifo example vhdl code
fifo example vhdl code