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其他嵌入式/单片机内容 verilog 编写的pic16c5x时钟模块

verilog 编写的pic16c5x时钟模块
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并行计算 这是一个用verilog实现的除法器代码。

这是一个用verilog实现的除法器代码。
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软件设计/软件工程 < 四人抢答器>>绝对好用的EDA程序!已经通过测试

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软件设计/软件工程 《出租车计费器》绝对好用的EDA程序!已经通过测试!VHDL语言编写

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软件设计/软件工程 《序列检测器》绝对好用的EDA实验程序,已经通过测试!VHDL语言编写

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软件设计/软件工程 《分频器设计》绝对好用的EDA实验程序!已经通过测试。VHDL语言编写

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VHDL/FPGA/Verilog 这是一个数字时钟的Verilog程序 仿真通过 能实现秒 分 时 计时

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https://www.eeworm.com/dl/663/213740.html
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VHDL/FPGA/Verilog Verilog 编写的fir滤波器

Verilog 编写的fir滤波器,可以实现fir滤波器的功能
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VHDL/FPGA/Verilog 这是个基于 Xilinx Spartan3 的加法器

这是个基于 Xilinx Spartan3 的加法器,利用Verilog语言编写,对于EDA初学者来说有一定的参考价值。
https://www.eeworm.com/dl/663/214503.html
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