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其他嵌入式/单片机内容 turbo码的verilog程序

turbo码的verilog程序,有意者请下载。
https://www.eeworm.com/dl/687/182737.html
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VHDL/FPGA/Verilog umti协议中的usb1.1的verilog原文件

umti协议中的usb1.1的verilog原文件,可公实现usb2.0做参考
https://www.eeworm.com/dl/663/182855.html
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VHDL/FPGA/Verilog usb1.1的verilog源代码。以及其测试仿真文件

usb1.1的verilog源代码。以及其测试仿真文件,现在很难找其测试文件既testbench
https://www.eeworm.com/dl/663/182856.html
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VHDL/FPGA/Verilog eda课程设计:数字钟--vhdl语言全部源代码

eda课程设计:数字钟--vhdl语言全部源代码
https://www.eeworm.com/dl/663/182899.html
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文件格式 eda zhuangtaiji vhdl

eda zhuangtaiji vhdl
https://www.eeworm.com/dl/639/182913.html
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VHDL/FPGA/Verilog verilog HDL原码 一种简单的同步FIFO原码

verilog HDL原码 一种简单的同步FIFO原码,可以被综合
https://www.eeworm.com/dl/663/183280.html
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VHDL/FPGA/Verilog 华为内部的verilog教材的ppt版本。比较详细。

华为内部的verilog教材的ppt版本。比较详细。
https://www.eeworm.com/dl/663/183363.html
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嵌入式/单片机编程 verilog程序

verilog程序,实现两个16bit数乘法,采用booth算法,基于状态机实现,分层次为datapath和controller两个子模块,testBench测试通过
https://www.eeworm.com/dl/647/183929.html
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嵌入式/单片机编程 verilog实现电子时钟模块

verilog实现电子时钟模块,输入60Hz时钟信号和复位,输出时分秒,共6位,每位7段输出用于驱动
https://www.eeworm.com/dl/647/183930.html
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嵌入式/单片机编程 verilog实现

verilog实现,UDP描述带有异步复位的正边沿触发D触发器,test测试通过
https://www.eeworm.com/dl/647/183931.html
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