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教程资料 Altera cyclone ep1c6对sram idt71系列的读写时序控制
Altera cyclone ep1c6对sram idt71系列的读写时序控制
文章/文档 1. Create the Virus Program. * * 2. The Virus Modifies IDT to Get Ring0 Privilege.
1. Create the Virus Program. * * 2. The Virus Modifies IDT to Get Ring0 Privilege.
VHDL/FPGA/Verilog Altera cyclone ep1c6对sram idt71系列的读写时序控制
Altera cyclone ep1c6对sram idt71系列的读写时序控制
系统设计方案 IDT7132/7142 是一种高速 2k×8 双端口静态 RAM
IDT7132/7142 是一种高速 2k×8 双端口静态 RAM，它拥有两套完全独立的
数据、地址和读写控制线。文中分析了双端口 RAM（DPRAM）的设计方案。并
以 IDT7132/7142 为例介绍了双端口 RAM 的时序、竞争和并行通讯接口设计以及
雷达仿真平台中的应用。 ...
USB编程 Samsung公司的部分datasheet IDT公司的部分datasheet Intel公司的部分datasheet AMCC公司的部分datasheet AMD公司的部分datasheet
Samsung公司的部分datasheet
IDT公司的部分datasheet
Intel公司的部分datasheet
AMCC公司的部分datasheet
AMD公司的部分datasheet
技术资料 公共通用无线接口协议的FPGA实现
本文主要分析了CPRI协议，并通过FPGA实现了一个CPRI协议应用评估系统。主要工作包括： 第一章介绍了无线通信系统的框架，网络拓扑，以及无线射频单元(RE)的在系统中的作用，针对现在无线网络覆盖中的缺陷，阐述了CPRI协议在无线通信系统中的作用和意义。 第二章详细分析了CPRI协议。CPRI协议定义了物理层和数据链路层协议。 ...
系统设计方案 以TI公司的DSP芯片TMS32OC6204为例
以TI公司的DSP芯片TMS32OC6204为例，结合IDT公司的先进先出缓存芯片IDT72V3640，介绍了其扩展总线XB在DMA控制下对FIFO进行读写，以实现对图像的实时采集、处理。
Windows CE 本人编写的WINCE5.0下DPRAM的驱动程序
本人编写的WINCE5.0下DPRAM的驱动程序，DPRAM芯片IDT70V05.
技术资料 实时图像处理系统的DSP实现
· 摘要： 本文以TI公司的DSP芯片TMS320C6204为例,结合IDT公司的先进先出缓存芯片IDT72V3640,介绍了其扩展总线XB在DMA控制下对FIFO进行读写,以实现对图像的实时采集、处理.
单片机开发 C8051020最终应用程序
C8051020最终应用程序，和IDT7202配合使用的程序，做的是简易数字示波器