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教程资料  赛灵思Artix-7 FPGA 数据手册:直流及开关特性

　　本文是关于赛灵思Artix-7 FPGA 数据手册:直流及开关特性的详细介绍。　　文章中也讨论了以下问题：　　1.全新 Artix-7 FPGA 系列有哪些主要功能和特性? 　　Artix-7 系列提供了业界最低功耗、最低成本的 FPGA，采用了小型封装，配合Virtex 架构增强技术，能满足小型化产品的批量市场需求，这也正是此前 Spart ...

https://www.eeworm.com/dl/fpga/doc/32512.html

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Artix FPGA 赛灵思数据手册

教程资料  高级FPGA教学实验指导书－嵌入式系统设计部分

高级FPGA 教学实验平台实验指导书－嵌入式系统设计

https://www.eeworm.com/dl/fpga/doc/32521.html

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FPGA 教学实验指导书嵌入式系统设计

教程资料  基于FPGA的全新数字化PCM中频解调器设计

为了对中频PCM信号进行直接解调，提出一种全新的数字化PCM中频解调器的设计方法。在实现过程中，采用大规模的FPGA芯片对位帧同步器进行了融合，便于设备的集成化和小型化。这种新型的中频解调器比传统的基带解调器具有硬件成本低和误码率低等优点。 ...

https://www.eeworm.com/dl/fpga/doc/32570.html

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FPGA PCM 数字化中频

教程资料  FPGA数字电子系统设计与开发实例导航(源程序)

FPGA数字电子系统设计与开发实例导航(源程序)        1每个项目都有说明文件，介绍使用方法。

https://www.eeworm.com/dl/fpga/doc/32675.html

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FPGA 数字电子开发实例导航

教程资料  基于FPGA的光纤通信系统中帧同步头检测设计

　为实现设备中存在的低速数据光纤通信的同步复接/ 分接,提出一种基于FPGA 的帧同步头信号提取检测方案,其中帧头由7 位巴克码1110010 组成,在数据的接收端首先从复接数据中提取时钟信号,进而检测帧同步信号,为数字分接提供起始信号,以实现数据的同步分接。实验表明,此方案成功地在光纤通信系统的接收端检测到帧同步信号,从 ...

https://www.eeworm.com/dl/fpga/doc/32680.html

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FPGA 光纤通信系统帧同步检测

教程资料  一种混沌伪随机序列发生器的FPGA实现

随着混沌理论应用于产生伪随机序列的发展，用现场可编程逻辑门阵列实现了基于TD—ERCS混沌的伪随机序列发生器．为了便于硬件实现并减少硬件占用资源．对原算法(即基于TD—ERCS构造伪随机序列发生器的算法)进行了适当改进，密钥空间缩减到2&#8943;．设计采用双精度浮点运算，选用Cyclone系列的EPIC20F400芯片。完成了CPRSG的 ...

https://www.eeworm.com/dl/fpga/doc/32686.html

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FPGA 混沌伪随机序列发生器

教程资料  基于FPGA的新型高性能永磁同步电机驱动系统设计

为了研制高性能的全数字永磁同步电机驱动系统，本文提出了一种基于FPGA的单芯片驱动控制方案。它采用硬件模块化的现代EDA设计方法，使用VHDL硬件描述语言，实现了永磁同步电机矢量控制系统的设计。方案包括矢量变换、空间矢量脉宽调制(SVPWM)、电流环、速度环以及串行通讯等五部分。经过仿真和实验表明，系统具有良好的稳定 ...

https://www.eeworm.com/dl/fpga/doc/32695.html

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FPGA 性能永磁同步电机驱动

教程资料  基于FPGA的数字三相锁相环的优化设计

数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明，优化后的数字三相锁相环大大节省了FPGA的资源，并能快速、准确 ...

https://www.eeworm.com/dl/fpga/doc/32702.html

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FPGA 数字三相优化设计

通信网络  基于FPGA的高动态GPS信号FFT快捕设计与实现

FPGA与GPS

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FPGA FFT GPS 动态

嵌入式综合  基于CY7C68013A的FPGA配置和通信接口设计

为了同时实现计算机对FPGA进行在线配置和高速数据传输，提出了一种基于CY7C68013A芯片的USB2.0接口设计方案。介绍了以CY7C68013A芯片为核心的系统硬件电路设计和软件编程，详细分析了CY7C68013A固件程序设计方法。CY7C68013A芯片在配置FPGA时受芯片内部CPU控制，配置速度为6 Mb/s，而在数据传输时采用从属FIFO模式以实现高 ...

https://www.eeworm.com/dl/566/34580.html

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68013A C68013 68013 FPGA

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