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汇编语言  系统时间显示程序利用BIOS的INT 1AH的2号系统功能调用

系统时间显示程序利用BIOS的INT 1AH的2号系统功能调用，将计算机系统的时间参数（BCD码）送入寄存器。其中CH 和CL中保存的是小时数和分钟数；DH中保存的是秒钟数，将BCD码表示的时，分，秒转换成ASC I I码并送入屏幕显示。并用INT 21H 的7号功能调用判断输入回车并清屏 ...

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VHDL/FPGA/Verilog 7段数码显示译码器设计7段数码是纯组合电路

7段数码显示译码器设计7段数码是纯组合电路，通常的小规模专用IC，如74或4000系列的器件只能作十进制BCD码译码，然而数字系统中的数据处理和运算都是二进制的，所以输出表达都是十六进制的，为了满足十六进制数的译码显示，最方便的方法就是利用译码程序在FPGA/CPLD中来实现。例子作为七段译码器，输出信号LED7S的7位分别接 ...

https://www.eeworm.com/dl/663/353703.html

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VHDL/FPGA/Verilog verilogHDL 入门的小程序

verilogHDL 入门的小程序，主要完成译码功能，从一个4位的2进制数转变成8位BCD吗

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汇编语言  被除数由高到低存于TEMP_STR-->TEMP_STR+4中

被除数由高到低存于TEMP_STR-->TEMP_STR+4中，除数存于TEMP_STR+10-->TEMP_STR+14中, 运算后商存于TEMP_STR-->TEMP_STR+4中，余数存于TEMP_STR+5-->TEMP_STR+9中高字节在前方法：移位相除 10位BCD码除法 XUE:20080729

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汇编语言  进入MF2K汇编语言开发环境

进入MF2K汇编语言开发环境，将二进制转换为BCD码的汇编程序设计方法与程序

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VHDL/FPGA/Verilog Actel 基本VHDl模块源代码

Actel 基本VHDl模块源代码，包括BCD、LCD、PLL等

https://www.eeworm.com/dl/663/370204.html

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VHDL/FPGA/Verilog 基于Actel的VHDL编程

基于Actel的VHDL编程，实现BCD功能源代码

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单片机开发  功能：本程序主要是读出单个DS18B20芯片转换后的温度值

功能：本程序主要是读出单个DS18B20芯片转换后的温度值，并把它转换成BCD码，范围（-55℃~99℃）。

https://www.eeworm.com/dl/648/376131.html

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单片机开发  电子闹钟 clk：标准时钟信号

电子闹钟 clk：标准时钟信号，本例中，其频率为4Hz； clk_1k：产生闹铃音、报时音的时钟信号，本例中其频率为1024Hz； mode：功能控制信号；为0：计时功能；为1：闹钟功能；为2：手动校时功能； turn：接按键，在手动校时功能时，选择是调整小时，还是分钟；若长时间按住该键，还可使秒信号清零，用于精确调时； c ...

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VHDL/FPGA/Verilog --文件名：mine4.vhd。 --功能：实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 --A的占空比也是可控的）

--文件名：mine4.vhd。 --功能：实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 --A的占空比也是可控的），可以存储任意波形特征数据并能重现该波形，还可完成 --各种波形的线形叠加输出。 --说明： SSS（前三位）和SW信号控制4种常见波形种哪种波形输出。4种波形的频率、 --幅度(基准幅度A)的 ...

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