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数据结构  贪心算法,8皇后问题

贪心算法,8皇后问题

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软件设计/软件工程  软件工程附录: 6、模块开发卷宗（GB8567——88） 7、软件问题报告单SPR 8、软件需求说明书（GB856T——88） 9、数据库设计说明书（GB8567——88） 10、数据要求说

软件工程附录: 6、模块开发卷宗（GB8567——88） 7、软件问题报告单SPR 8、软件需求说明书（GB856T——88） 9、数据库设计说明书（GB8567——88） 10、数据要求说明书（GB856T——88）

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VHDL/FPGA/Verilog 本文件是利用verilog实现的3-8译码器

本文件是利用verilog实现的3-8译码器

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单片机开发  Proteus6.9.04汉化文件

Proteus6.9.04汉化文件，可以用来汉化Proteus6.9.04。

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VHDL/FPGA/Verilog 本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统

本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统，能够用十进制数码显示被测信号的频率，不仅能够测量正弦波、方波和三角波等信号的频率，而且还能对其他多种物理量进行测量。具有体积小、可靠性高、功耗低的特点。 ...

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文章/文档  // big5 轉 utf-8 時用的 proxy url

// big5 轉 utf-8 時用的 proxy url

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VHDL/FPGA/Verilog 8位深

8位深，9位宽FIFO VHDL源码设计，如需改进可在此基础上扩展

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单片机开发  从虚拟终端输入8个任意数据

从虚拟终端输入8个任意数据，通过串口传送给单片机的led_buf缓冲区，并在8个led上显示；按回车键对led_buf缓冲区中的数据进行由小到大排序，排序结果在led上显示。

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单片机开发  8位定时器H1(PWM 输出)

8位定时器H1(PWM 输出)

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VHDL/FPGA/Verilog 8位十进制频率计,通过验证,目标芯片EPF10KLC84-4

8位十进制频率计,通过验证,目标芯片EPF10KLC84-4

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