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书籍源码 设计一个数字FIR低通滤波器
设计一个数字FIR低通滤波器，其技术指标如下：Wp=0.2 Rp=0.25 Ws=0.3 As=50
技术资料 MFRC500code.rar
飞利浦公司射频卡S50、S70短距离射频卡读卡芯片RC500程序
技术资料 stm32 AD采集
利用STM32开发版，AD采集50Hz的正选信号，并利用Lcd将结果显示出来。
技术资料 AC-DC-AC双pwm逆变器的Matlab/Simulink仿真源程序
AC-DC-AC双pwm逆变器的Matlab/Simulink仿真源程序。包括两个电路：一个是50Hz三相 AC(PWM整流)->DC->50Hz三相AC(PWM逆变),驱动三相对称电阻负载；一个是60Hz 三相AC(全波整流)->DC->50Hz三相AC（PWM逆变），驱动一个永磁同步电动机。
通讯/手机编程 心电信号加入0.5Hz的基线漂移
心电信号加入0.5Hz的基线漂移，通过0.5Hz高通滤波器，滤波后的波形与原波形的对比 ，滤波器特性曲线分析；信号加入50Hz工频漂移，通过50Hz陷波器，滤波后的波形与原波形的对比 ，滤波器特性曲线分析
技术资料 LIS8712B 12W 40V/280mA 单电压应用 LED 驱动方案
LIS8712B 12W 40V/280mA 单电压应用 LED 驱动方案
Input: 180Vac/50Hz~264Vac/50Hz;
Output: 27V~40V/220mA~280mA
欢迎索取资料，全程技术支持！ 请联系QQ：2355827368 联系电话；13823547041 袁先生
技术资料 心电信号加入0.5Hz的基线漂移
心电信号加入0.5Hz的基线漂移，通过0.5Hz高通滤波器，滤波后的波形与原波形的对比 ，滤波器特性曲线分析；信号加入50Hz工频漂移，通过50Hz陷波器，滤波后的波形与原波形的对比 ，滤波器特性曲线分析
VHDL/FPGA/Verilog ALTERA上DE2平台
ALTERA上DE2平台，利用内部50M Hz时钟，在数码管模拟显示时间(时分秒)。
编译器/解释器 this is a stepper motor controller with specifications pins: for RS-232 interfacing stepper motor:
this is a stepper motor controller with specifications pins: for RS-232 interfacing
stepper motor: 47-50 bus
PUSH button: 9-15
POTEN:9-15
VHDL/FPGA/Verilog 采用Verilog hel语言实现VGA的驱动
采用Verilog hel语言实现VGA的驱动，非常实用的源程序，有工程，晶振为有源晶振50的