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4位乘法器 的查询结果
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VHDL/FPGA/Verilog 精通verilog HDL语言编程源码之4--常用除法器设计
精通verilog HDL语言编程源码之4--常用除法器设计
VHDL/FPGA/Verilog 超前进位加法器是通常数字设计所必备的
超前进位加法器是通常数字设计所必备的，本程序为32位超前进位加法器
VHDL/FPGA/Verilog 此程序为32-bit乘法器
此程序为32-bit乘法器，另附有VHDL测试程序
VHDL/FPGA/Verilog 乘法器 verilog CPLD EPM1270 源代码
乘法器
verilog CPLD
EPM1270
源代码
VHDL/FPGA/Verilog Verilog HDL下的4 位数字频率计控制模块源代码
Verilog HDL下的4 位数字频率计控制模块源代码
Linux/Unix编程 实现UNIX下的ls全部功能,同时添加了可以生成目录树.实现内容:1.如何读取目录的内容 2.目录排序 3.文件类型以及如何知道文件的类型 4.位操作及掩码的使用 5.用户与组ID数据库 6
实现UNIX下的ls全部功能,同时添加了可以生成目录树.实现内容:1.如何读取目录的内容
2.目录排序
3.文件类型以及如何知道文件的类型
4.位操作及掩码的使用
5.用户与组ID数据库
6.UNIX文件系统的内部结构：i-节点和数据块
7.更改当前目录
8.输出颜色的改变和分栏
9.学习并实现ls命令各参数
10.解析命令行参数 ...
单片机开发 用51单片机P0口高四位驱动LCM1601显示模块 采用显示芯片的4位模式
用51单片机P0口高四位驱动LCM1601显示模块
采用显示芯片的4位模式
单片机开发 用51单片机P0口低四位驱动LCM1601显示模块 采用显示芯片的4位模式
用51单片机P0口低四位驱动LCM1601显示模块
采用显示芯片的4位模式
单片机开发 采用4位数据线的1602液晶驱动c语言程序 PWM利用Timer1的OC1A脚输出占空比可调的信号
采用4位数据线的1602液晶驱动c语言程序
PWM利用Timer1的OC1A脚输出占空比可调的信号
VHDL/FPGA/Verilog 复乘法器的FPGA实现
复乘法器的FPGA实现， 希望对初学者有帮助