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电路图 BLDC驱动详细设计文档

[内部资料]BLDC详细设计文档包括原理图
https://www.eeworm.com/dl/507/16281.html
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电路图 LPC1788 驱动7寸屏幕原理图

LPC1788 驱动7寸屏幕原理图 老外设计的 值得借鉴!!
https://www.eeworm.com/dl/507/16399.html
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教程资料 利用FPGA驱动LED显示

FPGA驱动LED显示:运用硬件描述语言(如VHDL)设计一个显示译码驱动器,即将要显示的字符译成8段码。由于FPGA有相当多的引脚端资源,如果显示的位数N较少,可以直接使用静态显示方式,即将每一个数码管都分别连接到不同的8个引脚线上,共需要8×N条引脚线控制. ...
https://www.eeworm.com/dl/fpga/doc/17716.html
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教程资料 CPLD实用设计50例

CPLD实用设计50例,非常经典的CPLD设计,包含50个实际的典型应用,涉及直流电机PWM驱动,编码等内容,有了这50例,举一反三,就会了很多应用
https://www.eeworm.com/dl/Protel/doc/18075.html
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教程资料 CPLD设计实现智能机器小车主要完成寻迹功能等

智能机器小车主要完成寻迹功能,由机械结构和控制单元两个部分组成。机械结构是一个由底盘、前后辅助轮、控制板支架、传感器支架、左右驱动轮、步进电机等组成。控制单元部分主要由主要包含传感器及其调理电路、步进电机及驱动电路、控制器三个部分。本设计的核心为控制器部分,采用Altera MAX7000S系列的EPM7064LC84-15作 ...
https://www.eeworm.com/dl/Protel/doc/18480.html
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allegro Allegro印制电路板设计610

Cadence Allegro印制电路板设计610,作为Allegro系统互连设计平台的一个600系列产品,是一个完整的、高性能印制电路板设计套件。通过顶尖的技术,它为创建和编辑复杂、多层、高速、高密度的印制电路板设计提供了一个交互式、约束驱动的设计环境。它允许用户在设计过程的任意阶段定义、管理和验证关键的高速信号,并能抓住今 ...
https://www.eeworm.com/dl/allegro/20124.html
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模拟电子 高增益低功耗恒跨导轨到轨CMOS运放设计

基于CSMC的0.5 μmCMOS工艺,设计了一个高增益、低功耗、恒跨导轨到轨CMOS运算放大器,采用最大电流选择电路作为输入级,AB类结构作为输出级。通过cadence仿真,其输入输出均能达到轨到轨,整个电路工作在3 V电源电压下,静态功耗仅为0.206 mW,驱动10pF的容性负载时,增益高达100.4 dB,单位增益带宽约为4.2 MHz,相位裕 ...
https://www.eeworm.com/dl/571/20305.html
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模拟电子 数字钟实验电路的设计与仿真

基于Multisim 10 软件对数字钟电路进行设计和仿真。采用555定时器产生秒时钟信号,用时钟信号驱动计数电路进行计数,将计数结果进行译码,最终在LED数码管上以数字的形式显示时、分、秒时间。
https://www.eeworm.com/dl/571/20848.html
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模拟电子 带有增益提高技术的高速CMOS运算放大器设计

设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构,利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度,100 MS/s采样频率的高速流水线(Pipelined)ADC的运放。设计基于SMIC 0.25 μm CMOS工艺,在Cadence环境下对电路进行Spectre仿真。仿真结 ...
https://www.eeworm.com/dl/571/21020.html
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模拟电子 CMOS工艺多功能数字芯片的输出缓冲电路设计

为了提高数字集成电路芯片的驱动能力,采用优化比例因子的等比缓冲器链方法,通过Hspice软件仿真和版图设计测试,提出了一种基于CSMC 2P2M 0.6 μm CMOS工艺的输出缓冲电路设计方案。本文完成了系统的电原理图设计和版图设计,整体电路采用Hspice和CSMC 2P2M 的0.6 μm CMOS工艺的工艺库(06mixddct02v24)仿真,基于CS ...
https://www.eeworm.com/dl/571/21132.html
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