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教程资料 FPGA输出数据的时频域分析GUI界面

FPGA输出数据的时频域分析GUI界面,\r\n可观察信号的时域频域波形,星座图眼图等特性
https://www.eeworm.com/dl/fpga/doc/18384.html
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教程资料 Verilog实现的DDS正弦信号发生器和测频测相模块

Verilog实现的DDS正弦信号发生器和测频测相模块,DDS模块可产生两路频率和相位差均可预置调整的值正弦波,频率范围为20Hz-5MHz,相位范围为0°-359°,测量的数据通过引脚传输给单片机,单片机进行计算和显示。
https://www.eeworm.com/dl/fpga/doc/18425.html
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教程资料 基于DSP+FPGA的扩频接收机快捕技术

基于DSP+FPGA的扩频接收机快捕技术,一片技术文章
https://www.eeworm.com/dl/fpga/doc/18439.html
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教程资料 用Verilog实现基于FPGA的通用分频器

用Verilog实现基于FPGA的通用分频器
https://www.eeworm.com/dl/fpga/doc/18476.html
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教程资料 分频器 FPGA程序设计 二分频

分频器 FPGA程序设计 二分频 对硬件设计有很大用处\r\n
https://www.eeworm.com/dl/fpga/doc/18501.html
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教程资料 一个好用的整数分频电路 能够实现对任意整数的分频电路设计

一个好用的整数分频电路 保证你喜欢 能够实现对任意整数的分频电路设计
https://www.eeworm.com/dl/Protel/doc/18578.html
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教程资料 基于FPGA测控系统研究论文

基于FPGA测控系统研究论文,内容相当不错,解压后格式为nh用CAJViewer打开
https://www.eeworm.com/dl/fpga/doc/18579.html
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教程资料 基于CPLD-FPGA的半整数分频器的设计

基于CPLD-FPGA的半整数分频器的设计,用于设计EDA
https://www.eeworm.com/dl/fpga/doc/18662.html
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教程资料 VHDL源程序:半整数分频器电路

半整数分频器电路的VHDL源程序,供大家学习和讨论。\r\n
https://www.eeworm.com/dl/fpga/doc/18701.html
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教程资料 Allegro快捷键

虽然这个很普通,但我相信很多人想拥有它..Allegro快捷键
https://www.eeworm.com/dl/cadence/doc/18703.html
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