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频率计 的查询结果
单片机开发 keil c程序,用于AT89S52单片机.使用了T2计数器,有频率计的功能
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其他嵌入式/单片机内容 单片机 语言编写 注释详细 7.8等精度数字频率计的实现
单片机 语言编写
注释详细
7.8等精度数字频率计的实现
嵌入式/单片机编程 学verilog时写的8位十进制频率计
学verilog时写的8位十进制频率计，开发环境为quartus II6.0.
单片机开发 在C51下编写的频率计函数
在C51下编写的频率计函数，可以对测得输入信号的频率
VHDL/FPGA/Verilog 基于EDA技术设计4位十进制数字频率计的系统方案
基于EDA技术设计4位十进制数字频率计的系统方案
VHDL/FPGA/Verilog 数字频率计VHDL程序与仿真 文件名：plj.vhd。 --功能：频率计。具有4位显示
数字频率计VHDL程序与仿真
文件名：plj.vhd。
--功能：频率计。具有4位显示，能自动根据7位十进制计数的结果，自动选择有效数据的
--高4位进行动态显示。小数点表示是千位，即KHz。
VHDL/FPGA/Verilog 四位十进制频率计设计 包含测频控制器（TESTCTL）
四位十进制频率计设计
包含测频控制器（TESTCTL），4位锁存器(REG4B)，十进制计数器（CNT10）的原程序(vhd)，波形文件(wmf ),包装后的元件(bsf)。顶层原理图文件（Block1.bdf）和波形。
单片机开发 实验箱整体布局及各实验模块框图.实验一、函数信号发生器,实验二、交实验四、扫频电源,流毫伏表,实验三、单片机低频信号发生器,实验五、频率计,实验十、二阶网络函数的模拟,实验十一、抽样定理
实验箱整体布局及各实验模块框图.实验一、函数信号发生器,实验二、交实验四、扫频电源,流毫伏表,实验三、单片机低频信号发生器,实验五、频率计,实验十、二阶网络函数的模拟,实验十一、抽样定理
VHDL/FPGA/Verilog 智能频率计 1. 频率测量范围为1Hz~1MHz 2. 当频率在1KHz以下时采用测周方法 其它情 况采用测频方法.二者之间自动转换 3. 测量结果显示在数码管上,单位可以是Hz
智能频率计
1. 频率测量范围为1Hz~1MHz
2. 当频率在1KHz以下时采用测周方法 其它情
况采用测频方法.二者之间自动转换
3. 测量结果显示在数码管上,单位可以是Hz（Ｈ）、
KHz（ＡＨ）或MHz（ＢＨ）。
４. 测量过程不显示数据，待测量结果结束后，直接显示结果。 ...