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频率计设计 的查询结果
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汇编语言 此为等精度数字频率计的设计
此为等精度数字频率计的设计，用单片机汇编语言和VHDL语言实现准确的频率采集功能。
嵌入式/单片机编程 用单片机设计频率计 用单片机设计频率计 用单片机设计频率计
用单片机设计频率计
用单片机设计频率计
用单片机设计频率计
VHDL/FPGA/Verilog （１）设计一个4位十进制的频率计其测量范围1Hz~9.999KHz；6 N3 G8 k( U- @ n* A （２）记数过程结束后
（１）设计一个4位十进制的频率计其测量范围1Hz~9.999KHz；6 N3 G8 k( U- @ n* A
（２）记数过程结束后，保存并显示结果；
单片机开发 一﹑指标要求：. A: f5 b G A( d8 n （１）设计一个4位十进制的频率计其测量范围1Hz~9.999KHz；6 N3 G8 k( U- @ n* A （２）记数过程结束
一﹑指标要求：. A: f5 b G A( d8 n
（１）设计一个4位十进制的频率计其测量范围1Hz~9.999KHz；6 N3 G8 k( U- @ n* A
（２）记数过程结束后，保存并显示结果；
单片机开发 本频率计的设计以AT89C51单片机为核心
本频率计的设计以AT89C51单片机为核心，利用他内部的定时／计数器完成待测信号周期／频率的测量。
VHDL/FPGA/Verilog 基于vhdl 的数字频率计的设计源程序及工程文件
基于vhdl 的数字频率计的设计源程序及工程文件，已在实验箱上实现
VHDL/FPGA/Verilog 设计一个用等精度测频原理的频率计。 频率测量范围1~9999； 其精度为 ； 用4位带小数点数码管显示其频率； 并且具有超量程、欠量程提
设计一个用等精度测频原理的频率计。
频率测量范围1~9999；
其精度为 ；
用4位带小数点数码管显示其频率；
并且具有超量程、欠量程提示功能；
VHDL/FPGA/Verilog 基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序
基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序
电子技术 一种智能频率计的设计与制作(AVR)proteus仿真+程序资料
0083、一种智能频率计的设计与制作(AVR)proteus仿真+程序资料
无线通信 数字频率计的设计与制作
数字频率计的设计与制作