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频率计数器 的查询结果
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VHDL/FPGA/Verilog 可自由配置的通用计数器
可自由配置的通用计数器，我设计的时候一直在用
单片机开发 电动绕线机计数器（电路及源代码）.很简单的入门的东东。 简要说明 2004年12月做的小项目
电动绕线机计数器（电路及源代码）.很简单的入门的东东。
简要说明
2004年12月做的小项目，40来台机，已在车间运行n年了。
<电动绕线机计数控制器>
包括汇编源代码、烧录代码
开发环境：Keil
光电开关作计数
每转10个脉冲，用中断计数。
可设定停机数。
可以正反转计数
工作稳定
可快速预置4组数值
可循环在两组设定数之关 ...
VHDL/FPGA/Verilog 基于VHDL的4位带异步清零的二进制计数器。
基于VHDL的4位带异步清零的二进制计数器。
VHDL/FPGA/Verilog 基于VHDL的8位十进制频率计的详细设计。
基于VHDL的8位十进制频率计的详细设计。
VHDL/FPGA/Verilog VHDL计数器的TestBench
VHDL计数器的TestBench，适合初学者
汇编语言 将计数器0设置为方式0
将计数器0设置为方式0，计数器初值设为0H~FH，用手动逐个输入单脉冲，编成使计数值在屏幕上显示，并同时用逻辑笔观察OUT0点平变化。程序如下：
其他嵌入式/单片机内容 采用等精度测频原理的频率计的程序与仿真,用verilog语言实现,可以仿真综合得到所想时序!
采用等精度测频原理的频率计的程序与仿真,用verilog语言实现,可以仿真综合得到所想时序!
其他书籍 一个用门电路做的加、减计数器电路。非常简单好用。4年前在某单位做的。现在会单片机朋友不会再用这样的电路了
一个用门电路做的加、减计数器电路。非常简单好用。4年前在某单位做的。现在会单片机朋友不会再用这样的电路了，所以公开一下也没什么。
加一个电容后，掉电后，计数值在门电路中都还可以保存3天。
VHDL/FPGA/Verilog 采用Verilog HDL语言编写的数字频率计
采用Verilog HDL语言编写的数字频率计，被测波形分别为方波、三角波和正弦波；采用6个数码管显示结果，三档量程可调，工程价值很高，
VHDL/FPGA/Verilog 有限状态机的并行编码,采用并行编码可以有效提高系统最高频率,次态时间充分被利用.
有限状态机的并行编码,采用并行编码可以有效提高系统最高频率,次态时间充分被利用.