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VHDL/FPGA/Verilog 这是用VHDL语言编写的一个DDS频率合成器的源程序

这是用VHDL语言编写的一个DDS频率合成器的源程序

https://www.eeworm.com/dl/663/208499.html

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行业发展研究  用MUSIC算法对信号波达方向和频率的研究.

用MUSIC算法对信号波达方向和频率的研究.

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其他  用数值计算方法研究三阶锁相环的非线性性能及其改善途径.建立具有正弦鉴相特性的三阶锁相环的动态非线性微分方程 ,通过编制数值解程序 ,求出不同条件下的相轨迹和时间响应图 ,分析了电路参数和初始条

用数值计算方法研究三阶锁相环的非线性性能及其改善途径.建立具有正弦鉴相特性的三阶锁相环的动态非线性微分方程 ,通过编制数值解程序 ,求出不同条件下的相轨迹和时间响应图 ,分析了电路参数和初始条件对三阶锁相环非线性性能的影响 ,并提出改善非线性性能的途径. ...

https://www.eeworm.com/dl/534/208970.html

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其他  这是一个用C语言编写的可以用键盘控制发声频率的程序

这是一个用C语言编写的可以用键盘控制发声频率的程序

https://www.eeworm.com/dl/534/209103.html

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单片机开发  用C编写的信号发生器的单片机程序,主要功能是能够接收计算机串口发送的消息,然后根据发送过来的数据来修改信号发生器的输出频率和相位

用C编写的信号发生器的单片机程序,主要功能是能够接收计算机串口发送的消息,然后根据发送过来的数据来修改信号发生器的输出频率和相位

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VHDL/FPGA/Verilog 蜂鸣器实验向蜂鸣器发送一定频率的方波可以使蜂鸣器发出相应的音调

蜂鸣器实验向蜂鸣器发送一定频率的方波可以使蜂鸣器发出相应的音调，该实验通过设计一个状态机和分频器使蜂鸣器发出“多来咪发梭拉西多”的音调。

https://www.eeworm.com/dl/663/209609.html

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VHDL/FPGA/Verilog 简易数字频率计

简易数字频率计，数码管显示，VHDL语言

https://www.eeworm.com/dl/663/210234.html

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系统设计方案  利用超高速硬件描述语言(VHDL)在现场可编程逻辑门阵列(FPGA)上编程实现的纯数字式等精度频率计

利用超高速硬件描述语言(VHDL)在现场可编程逻辑门阵列(FPGA)上编程实现的纯数字式等精度频率计，不但具有较高的测量精度，而且其测量精度不会随着被测信号频率的降低而下降。为了实现对任意信号进行频率测量，在前端输入加整形电路即可。 ...

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数据结构  问题的提出：编程模拟抛硬币所得正面的频率图。假设每次抛10次为一事件

问题的提出：编程模拟抛硬币所得正面的频率图。假设每次抛10次为一事件，记录每次得到正面的次数，共抛掷100000次，计算得到正面次数的概率发布，并绘图输出结果。思路：数值概率算法常用于数值问题的求解，此类算法所得的往往是近似解，且近似解的精度随计算时间的增加而不断提高，得到一定精度近似解就可以满足问题要 ...

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通讯/手机编程  在DSP中设计滤波器采样频率为600hz

在DSP中设计滤波器采样频率为600hz ，截止频率200hz 的高通滤波器IIR

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