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频率同步 的查询结果
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VHDL/FPGA/Verilog 按键输入模块（key）： --可编程延时发生器（数字同步机）的前端输入模块：0－9十个数字键按键输入模块原型 --前端模块：消抖 --对i0－i9十个输入端的两点要求： --（1）输入端要保证
按键输入模块（key）：
--可编程延时发生器（数字同步机）的前端输入模块：0－9十个数字键按键输入模块原型
--前端模块：消抖
--对i0－i9十个输入端的两点要求：
--（1）输入端要保证一段时间的稳定高电平
--（2）不能同时按下两个或多于两个的键
--后级模块：1、编码；2、可变模计数器
--编码模块：8线－4线（0－8 BCD码） ...
单片机开发 此频率计是用单片机89C51和几块数字电路几个三极管
此频率计是用单片机89C51和几块数字电路几个三极管，和一个微波集成电路构成。可测量频率最高为2G！分辨力为1HZ！电路中R16---R27电阻阻值为1K。这文件包里有两符制作成功后的图片！ 二个SCH。一个PCB文件。一个PDF文件。和一个程序HEX文件。制作的时候只要按线路板接好元件，然后把程序HEX文件烧写到单片机内，就可以调试 ...
VHDL/FPGA/Verilog 下面我们根据8251A芯片的使用体会对其在串行同步方式下的通信原理及应用进行着重介绍。在开始发送或接收之前
下面我们根据8251A芯片的使用体会对其在串行同步方式下的通信原理及应用进行着重介绍。在开始发送或接收之前，8251A必须装入一组由CPU 产生的控制字。
VHDL/FPGA/Verilog DDS的vhdl语言源程序实现 该程序可实现1HZ频率步进
DDS的vhdl语言源程序实现
该程序可实现1HZ频率步进
VHDL/FPGA/Verilog 同步复位与异步复位问题
同步复位与异步复位问题，应用于EDA设置，适合初学者
Internet/网络编程 Python实现的半同步半异步网络框架.在其上可以实现自己的应用层协议,以支持特定的应用.
Python实现的半同步半异步网络框架.在其上可以实现自己的应用层协议,以支持特定的应用.
VHDL/FPGA/Verilog 开发系统上采用的时钟信号的频率是20MHz
开发系统上采用的时钟信号的频率是20MHz，可分别设计计数器对其计数，包括计秒、分、小时、日、周、月以及年等。在每一级上显示输出，这样就构成了一个电子日历和时钟的模型。为了可以随意调整计数值，还应包含设定计数初值的电路 ...
数学计算 我自己写的一个已知RF的L.C计算谐振频率的计算
我自己写的一个已知RF的L.C计算谐振频率的计算，用VB编写。
VHDL/FPGA/Verilog vhdl语言实现的频率发生器
vhdl语言实现的频率发生器，可以产生不同的频率
单片机开发 基于51系列单片机的简易的频率到电压转换器
基于51系列单片机的简易的频率到电压转换器，工程实践中的经验总结