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VHDL/FPGA/Verilog ——9999计数器模块　四输出设计要求频率计为四段显示

——9999计数器模块　四输出设计要求频率计为四段显示，故计数器采用0~~9999计数，可以很好的利用数码管，以及增加频率计的精确度。模块内包含俩个进程，一为计数进程，二为时基信号控制计数模块数据输出进程。

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VHDL/FPGA/Verilog 控制模块是频率计的核心所在,具有如下所述功能：对输入数据判断并输出档位信号； ——10KHZ最高位为1010

控制模块是频率计的核心所在,具有如下所述功能：对输入数据判断并输出档位信号； ——10KHZ最高位为1010，换高档，最低位为0000，小数点不亮，表无信号； ——100KHZ最高位为1010，换高档，最高位为0000，换低档测试； ——1MHZ、10MHZ同100KHZ测试档。针对不同的档位输出不同的时基信号； ——100ms时基信号，用于10KHZ ...

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单片机开发  低频频率计实例目的：学习定时器、计数器、中断应用说明：选用24MHz的晶体

低频频率计实例目的：学习定时器、计数器、中断应用说明：选用24MHz的晶体，主频可达2MHz。用T1产生100us的时标，T0作信号脉冲计数器。假设晶体频率没有误差，而且稳定不变（实际上可达万分之一）；被测信号是周期性矩形波（正负脉冲宽度都不能小于0.5us），频率小于1MHz，大于1Hz。要求测量时标1S，测量精度为0.1％。 ...

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单片机开发  89S52频率计

89S52频率计，该程序是应用89S52单片机开发的频率计，程序应用语言编写

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单片机开发  单片机,显示波形,对频率,还有菜单学习很有帮助,希望对大家有用

单片机,显示波形,对频率,还有菜单学习很有帮助,希望对大家有用

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VHDL/FPGA/Verilog 用VHDL实现频率计

用VHDL实现频率计，可测量输入脉冲的频率，并进行简单校正

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VHDL/FPGA/Verilog DDS正弦信号发生器频率和相位连续可调。频率最大2M

DDS正弦信号发生器频率和相位连续可调。频率最大2M

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matlab例程  采用频率调制为1000Ｈｚ的载波

采用频率调制为1000Ｈｚ的载波，在解调前把加性白高斯噪声加入到调制信号。当噪声功率和调制信号功率比为０.００１，０.０１，０.０５，０.１和０.３是进行解调并绘出调制信号

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汇编语言  一个在MASM环境下开发的键盘模拟钢琴按键的汇编程序,本程序由三个模块组成：八度音程的钢琴程序即 main 通用发声程序soundf,它能利用定时器发出指定频率的声音；还有就是IBM PC AT BI

一个在MASM环境下开发的键盘模拟钢琴按键的汇编程序,本程序由三个模块组成：八度音程的钢琴程序即 main 通用发声程序soundf,它能利用定时器发出指定频率的声音；还有就是IBM PC AT BIOS中的WAITF子程序，它是一个与处理器无关的时间延迟。 ...

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嵌入式/单片机编程  自己写的把gif合成一个bin文件的程序

自己写的把gif合成一个bin文件的程序，适合在嵌入式环境下显示使用

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