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可编程逻辑 用VerilogHDL实现基于FPGA的通用分频器的设计
用VerilogHDL实现基于FPGA的通用分频器的设计
通讯编程文档 扩频通信中采用的线性调频算法用的复相关算法
扩频通信中采用的线性调频算法用的复相关算法
VHDL/FPGA/Verilog 用vhdl实现占空比1：1的通用分频模块
用vhdl实现占空比1：1的通用分频模块，非常实用，欢迎大家下载
VHDL/FPGA/Verilog 这是用VHDL语言写的32位分频器的程序
这是用VHDL语言写的32位分频器的程序，可直接运行，看结果，欢迎使用。多指正，交流。
VHDL/FPGA/Verilog 用VHDL编写的8位全加器,数字分频器等程序
用VHDL编写的8位全加器,数字分频器等程序
VHDL/FPGA/Verilog 用verilog写的cpld的各种分频程序
用verilog写的cpld的各种分频程序，希望大家指正，谢谢！
VHDL/FPGA/Verilog 用Verilog实现基于FPGA的通用分频器
用Verilog实现基于FPGA的通用分频器
VHDL/FPGA/Verilog 这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器，在运用时，不需要阅读VHDL源代码，只需要把clk_div2n.vhd加入当前工程便可以直接调用clk_div2n.bsf。
软件设计/软件工程 本文件介绍的是用VerilogHDL语言设计分频器和32位计数器.
本文件介绍的是用VerilogHDL语言设计分频器和32位计数器.
软件设计/软件工程 清楚地讲述了怎样用VHDL语言设计整数分频、小数分频、分数分频等
清楚地讲述了怎样用VHDL语言设计整数分频、小数分频、分数分频等，是学习VHDL不可多得的好材料！