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系统设计方案  FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术

FPGA弹弓无线呼叫系统分发射和接收两大部分。发射部分采用锁相环式频率合成器技术

https://www.eeworm.com/dl/678/301788.html

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其他嵌入式/单片机内容  这是锁相环芯片MC145170程序

这是锁相环芯片MC145170程序，单片机是用at89s52的

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matlab例程  用MATLAB的simulink实现costas环的.mhl文件

用MATLAB的simulink实现costas环的.mhl文件

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其他书籍  a环相关的复合系统多普勒频移抑制模型复合系统为扩频测距与通信复合系统

a环相关的复合系统多普勒频移抑制模型复合系统为扩频测距与通信复合系统

https://www.eeworm.com/dl/542/303977.html

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系统设计方案  gps的c_a码的跟踪环的研究的fpga实现

gps的c_a码的跟踪环的研究的fpga实现

https://www.eeworm.com/dl/678/304819.html

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系统设计方案  在总结前人提出的一些锁相环仿真模型的基础上

在总结前人提出的一些锁相环仿真模型的基础上，用Matlab语言构建了一种新的适用于全数字仿真模型。

https://www.eeworm.com/dl/678/307902.html

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其他  数据结构试验报告约瑟夫环问题描述: 约瑟夫（Joseph）问题的一种描述是：编号为1

数据结构试验报告约瑟夫环问题描述: 约瑟夫（Joseph）问题的一种描述是：编号为1，2，，...,n的n个人按顺时针方向围坐一圈，每人持有一个密码（正整数）。一开始任选一个正整数作为报数上限值m，从第一个人开始按顺时针方向自1开始顺序报数，报到m时停止报数。报m的人出列，将他的密码作为新的m值，从他在顺时针方向上的 ...

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VHDL/FPGA/Verilog 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太严格的设计，通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源，再者，这种方式只消耗不多的逻辑单 ...

https://www.eeworm.com/dl/663/308242.html

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VHDL/FPGA/Verilog 一阶全数字锁相环VERLOGIC程序代码

一阶全数字锁相环VERLOGIC程序代码，调试通过。

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其他  介绍了数字锁相环的3种设计方法

介绍了数字锁相环的3种设计方法，并对各自的工作原理做了详细分析。

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