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VHDL/FPGA/Verilog Design Compiler使用简要说明,说明了用这一工具进行综合的过程
Design Compiler使用简要说明,说明了用这一工具进行综合的过程
数据结构 演示了堆排序的算法逻辑
演示了堆排序的算法逻辑，且以MFC为开发工具，实现了可视化。
数据结构 演示了最短路径的算法逻辑
演示了最短路径的算法逻辑，以对话框为交互工具。
文件格式 使用MAPGIS做的 地图编制 河系制图 河流的综合
使用MAPGIS做的 地图编制 河系制图 河流的综合，包含有自己的做的图例板，及矢量化的图形。
其他 使用MAPGIS做的 地图编制 黄土地貌制图综合
使用MAPGIS做的 地图编制 黄土地貌制图综合 ，包含有自己的做的图例板，及矢量化的图形。
企业管理 《通用进销存管理系统》是集财务管理（钱流账）和商品进销存管理（物流账）的功能于一体的中小企业综合管理软件。
《通用进销存管理系统》是集财务管理（钱流账）和商品进销存管理（物流账）的功能于一体的中小企业综合管理软件。
其他 使用MAPGIS做的 地图编制 居民地制图综合
使用MAPGIS做的 地图编制 居民地制图综合 ，包含有自己的做的图例板，及矢量化的图形。
单片机开发 可编程逻辑设计的程序！24位十进制频率计！可使ＥＤＡ实验年箱测量指定频率！
可编程逻辑设计的程序！24位十进制频率计！可使ＥＤＡ实验年箱测量指定频率！
VHDL/FPGA/Verilog ALU算术逻辑单元的简单实现,利用VHDL语言编写,可进行加法,减法,以及位的左右移动,只需一个时钟脉冲
ALU算术逻辑单元的简单实现,利用VHDL语言编写,可进行加法,减法,以及位的左右移动,只需一个时钟脉冲
嵌入式/单片机编程 代码名称：组合逻辑电路仿真器 代码说明：组合逻辑电路仿真器 工具/平台：VC++ 作者：上官晨寰 邮件地址：sgch1982@163.com
代码名称：组合逻辑电路仿真器
代码说明：组合逻辑电路仿真器
工具/平台：VC++
作者：上官晨寰
邮件地址：sgch1982@163.com