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找到约 1,737 项符合 连续增减计数 的查询结果

其他 定时期的计数使用实例

定时期的计数使用实例,结合了数码管显示,适合于初学者的研究学习
https://www.eeworm.com/dl/534/397751.html
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其他 chi2实验(序列)是基于概率统计的连续属性离散化方法

chi2实验(序列)是基于概率统计的连续属性离散化方法
https://www.eeworm.com/dl/534/398196.html
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其他 连续小波变换的PPT格式

连续小波变换的PPT格式,基础性只是比较多,适用于初学者
https://www.eeworm.com/dl/534/398329.html
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单片机开发 使用8251发送数据实验连续发送一个二进制数(比如53H

使用8251发送数据实验连续发送一个二进制数(比如53H,F0H,AAH等),从示波器上观测数据的起始位、数据位和停止位。本实验要求在数码管上显示“8251-A04”。
https://www.eeworm.com/dl/648/399032.html
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matlab例程 基于MATLAB的信号分析与处理的课程设计 怎样的产生一个连续信号

基于MATLAB的信号分析与处理的课程设计 怎样的产生一个连续信号
https://www.eeworm.com/dl/665/401734.html
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其他 设计要求: (1). 在 1-- 8楼之间一次可输入多个任意楼层号连续控制电梯按指定楼层号顺序上升与下降.以上过程完成后可重新输入任意楼层号连续控制电梯按指定楼层号顺序上升与下降.只有按ESC键才

设计要求: (1). 在 1-- 8楼之间一次可输入多个任意楼层号连续控制电梯按指定楼层号顺序上升与下降.以上过程完成后可重新输入任意楼层号连续控制电梯按指定楼层号顺序上升与下降.只有按ESC键才退出程序返回DOS状态。例如 : 1-3-5-7-6-4-2-1 (可观察教十楼电梯的实际运行情况). (2). 在 1 -- 7 楼之间按任意顺序不连续控制 ...
https://www.eeworm.com/dl/534/401774.html
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VHDL/FPGA/Verilog VHDL的数字时钟程序 24小时计数显示; 具有校时功能(时

VHDL的数字时钟程序 24小时计数显示; 具有校时功能(时,分) ; 实现闹钟功能(定时,闹响);
https://www.eeworm.com/dl/663/402741.html
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单片机开发 HT1380串行实时时钟芯片具有接口简单、功耗低、工作电压范围宽、计时精确、功能全(可对分、秒、时、日、日期、月及带闰年补偿的年进行计数)、成本低等优点

HT1380串行实时时钟芯片具有接口简单、功耗低、工作电压范围宽、计时精确、功能全(可对分、秒、时、日、日期、月及带闰年补偿的年进行计数)、成本低等优点,因此在实际应用中被广泛采用,下面先简单介绍一下该芯片的情况,然后实际工作中采用的子程序供读者参考。 ...
https://www.eeworm.com/dl/648/402967.html
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matlab例程 使用MATLAB编写的GUI程序 可实现list菜单的增减

使用MATLAB编写的GUI程序 可实现list菜单的增减
https://www.eeworm.com/dl/665/403353.html
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VHDL/FPGA/Verilog 实现60进制的计数

实现60进制的计数,每60个脉冲上升沿进一次位。
https://www.eeworm.com/dl/663/403573.html
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