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输出波形 的查询结果
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其他 一个在Turbo C中使用的完整的DOS输入输出管理系统
一个在Turbo C中使用的完整的DOS输入输出管理系统
单片机开发 关于89c51驱动tcp/ip的驱动程序。包括了对tcp/ip转换为rs232协议输出
关于89c51驱动tcp/ip的驱动程序。包括了对tcp/ip转换为rs232协议输出
串口编程 本程序代码可以准确地生成1-500Hz波形文件
本程序代码可以准确地生成1-500Hz波形文件,正弦波,方波等。具体功能,下载下来,自己运行一下就知道了
DSP编程 基于TMS320LF2407芯片实现三相SPWM波形发生器
基于TMS320LF2407芯片实现三相SPWM波形发生器
其他 在dos环境下的汉子点阵信息输出和更改
在dos环境下的汉子点阵信息输出和更改,采用dos下的图形界面
加密解密 一个完整的MD5的加密器,可实现输出一个字符串,不错的
一个完整的MD5的加密器,可实现输出一个字符串,不错的
其他 用来将电脑连接到电视荧幕, 并以15Khz输出的源码, 请只用在支援15Khz的荧幕上, 以免伤害荧幕
用来将电脑连接到电视荧幕, 并以15Khz输出的源码, 请只用在支援15Khz的荧幕上, 以免伤害荧幕
编译器/解释器 vc实现的pl0编译器,有读取输出功能-read() -write(),这个源码对初学编译原理者有很好的指导作用,我当初学的时候用了3天看懂了源码,也对编译原理更加理解了,毕竟只学理论不看代码是不可能
vc实现的pl0编译器,有读取输出功能-read() -write(),这个源码对初学编译原理者有很好的指导作用,我当初学的时候用了3天看懂了源码,也对编译原理更加理解了,毕竟只学理论不看代码是不可能真正理解的,原作者是dwing,我对代码做了一些修改,在此感谢dwing提供的代码 ...
VHDL/FPGA/Verilog PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿
PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上;顶层文件是PLL.GDF
数据结构 由系统随机建立一个迷宫,然后屏幕输出路径。为在完成作业的同时复习所学过的内容,完成一条路径的时候用到了递归的方法 而做全部路径的时候用非递归的方法。用户界面友好
由系统随机建立一个迷宫,然后屏幕输出路径。为在完成作业的同时复习所学过的内容,完成一条路径的时候用到了递归的方法 而做全部路径的时候用非递归的方法。用户界面友好,有用户使用说明.每一步操作都有说明与提示。程序运行通过,有详细的解释说明 ...