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技术资料  参数化Viterbi译码器的FPGA实现

本文以某型号接收机的应用为背景，主要论述了如何实现基于FPGA的参数化的Viterbi译码器的知识产权(IP)核。文中详细论述了译码器的内部结构、VerilogHDL(硬件描述语言)实现、仿真测试等。这些可变的参数包括：码型、ACS(加比选)单元的数目、软判决比特数、回溯深度等。用户可以根据自己的需要设置不同的参数由开发工具生成不 ...

https://www.eeworm.com/dl/885758.html

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技术资料  SOPC中FPGAIP核配置方案研究与实现

本论文首先介绍SOPC的发展、应用及IP核复用技术，在研究FPGA的配置流程和I2C数据总线协议的基础上提出了在SOPC系统中用I2C总线对FPGA进行配置的方案。接着采用自顶向下的IC设计方法，通过Verilog HDL语言编程设计了I2C的主、从IP固核。利用FPGA软硬件接口系统机制的规律建立了I2C IP固核与FPGA配置部分、配置控制部分的连接 ...

https://www.eeworm.com/dl/931301.html

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FPGAIP SOPC

图形图像  774336592410-pcb.rar

一个全的2410试验板的原理图核PCB图,可以直接用,适合想做开发板的新手

https://www.eeworm.com/dl/530/4789.html

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774336592410 pcb

教程资料  利用FPGA实现DDS经过编译没有错误。编译环境为QuartusII7.2

利用FPGA实现DDS经过编译没有错误。编译环境为QuartusII7.2，该环境集成了IP核，可以提高开发效率。

https://www.eeworm.com/dl/fpga/doc/17710.html

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QuartusII FPGA DDS 7.2

教程资料  基于MAXII CPLD的对1602字符型液晶进行读写操作

基于MAXII CPLD的对1602字符型液晶进行读写操作，其中使用了一个CFI的IP核

https://www.eeworm.com/dl/Protel/doc/18244.html

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MAXII CPLD 1602 字符型液晶

嵌入式综合  NuMicro+NUC100_120+Technical+Reference+Manual+SC+V2.01技术手册

nuc120系列的MCU，是MO核的32位的数据手册，芯片功能多样，比STM32的功能强

https://www.eeworm.com/dl/566/34714.html

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Technical Reference NuMicro Manual

微处理器开发  一个关于声音处理的Verilog语言编写的解码芯片

一个关于声音处理的Verilog语言编写的解码芯片，可以用于FPGA处理芯片的IP核，欢迎大家来用。

https://www.eeworm.com/dl/655/167166.html

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Verilog 音处理语言编写

嵌入式/单片机编程  此源码是利用altera公司的NIOS II IDE开发的

此源码是利用altera公司的NIOS II IDE开发的，功能是通过spi 核控制AD/DA发三角波

https://www.eeworm.com/dl/647/195488.html

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altera NIOS IDE II

单片机开发  基于MAXII CPLD的对1602字符型液晶进行读写操作

基于MAXII CPLD的对1602字符型液晶进行读写操作，其中使用了一个CFI的IP核

https://www.eeworm.com/dl/648/282939.html

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MAXII CPLD 1602 字符型液晶

VHDL/FPGA/Verilog 基于FPGA的PCI接口设计

基于FPGA的PCI接口设计，介绍一种使用PCI宏核逻辑进行的更加简单高效的PCI口设计方法

https://www.eeworm.com/dl/663/295904.html

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FPGA PCI 接口设计

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