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VHDL/FPGA/Verilog 1、 掌握VHDL的结构以及实例的编程； 2、 学会使用QuartusⅡ平台的开化； 3、 设计一个2位BCD码加法器。
1、 掌握VHDL的结构以及实例的编程；
2、 学会使用QuartusⅡ平台的开化；
3、 设计一个2位BCD码加法器。
数据结构 使用加法器树乘法器实现8位乘法运算
使用加法器树乘法器实现8位乘法运算，VHDL语言予以实现
其他 这是一个用multisim编写的用8421BCD码表示的两个一位十进制数相加的加法器
这是一个用multisim编写的用8421BCD码表示的两个一位十进制数相加的加法器
VHDL/FPGA/Verilog 用vhdl语言 来实现 四位并行加法器的功能 是本科生的必学内容
用vhdl语言 来实现 四位并行加法器的功能 是本科生的必学内容
汇编语言 最高8位带符号的加法器的核心代码在masm上调试通过。
最高8位带符号的加法器的核心代码在masm上调试通过。
其他书籍 软件的使用程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,
软件的使用程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,
VHDL/FPGA/Verilog 一个32位元的浮点数加法器
一个32位元的浮点数加法器，可将两IEEE 754格式内的值进行相加
VHDL/FPGA/Verilog 32位元浮点数加法器,用于以VHDL编写的32位元CPU
32位元浮点数加法器,用于以VHDL编写的32位元CPU