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语言信号 的查询结果
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VHDL/FPGA/Verilog 功能为基于VHDL硬件描述语言
功能为基于VHDL硬件描述语言，完成对基带信号的MFSK调制
VHDL/FPGA/Verilog 基于VHDL硬件描述语言
基于VHDL硬件描述语言，对基带信号进行MPSK调制（这里M=4）
数值算法/人工智能 含有《数字信号处理－理论、算法与实现》一书中所涉及到的绝大部分算法,DSP_FORTRAN, DSP_C和DSP_MATLAB。DSP_FORTRAN和DSP_C各含有约40个信号处理的子程序
含有《数字信号处理－理论、算法与实现》一书中所涉及到的绝大部分算法,DSP_FORTRAN,
DSP_C和DSP_MATLAB。DSP_FORTRAN和DSP_C各含有约40个信号处理的子程序。 用C语言编写的MA模型、ARMA模型及最小方差谱估计三个算法程序.
单片机开发 该设计采用ADC0832实现了四种波形的信号发生器的设计
该设计采用ADC0832实现了四种波形的信号发生器的设计，采用C语言编程~！
GPS编程 基于verilog语言的ＧＰＳ模拟源代码
基于verilog语言的ＧＰＳ模拟源代码，代码为４颗星，包含噪声信号。
VC书籍 伪随机序列（N=4的M序列）的C语言编程实现
伪随机序列（N=4的M序列）的C语言编程实现，可以应用于相关分析法和最小二乘辨识的输入信号。
VHDL/FPGA/Verilog 电子设计自动化中关于交通信号的转换的实现程序
电子设计自动化中关于交通信号的转换的实现程序，基于VHDL语言实现的
VHDL/FPGA/Verilog 用VHDL语言实现一个能显示时、分、秒的时钟：可分别进行时和分的手动校正；12小时、24小时计时制可选
用VHDL语言实现一个能显示时、分、秒的时钟：可分别进行时和分的手动校正；12小时、24小时计时制可选，12小时制时有上下午指示；当计时到预定时间（此时间可手动设置）时，扬声器发出闹铃信号，闹铃时间为10秒，可提前终止闹铃。 ...