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译码器设计 的查询结果
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VHDL/FPGA/Verilog 练习用VHDL设计逻辑
练习用VHDL设计逻辑，用VHDL设计一个3-8译码器，对其进行时序仿真
VHDL/FPGA/Verilog 自己做的vhdl课程设计
自己做的vhdl课程设计，交通灯：实现主干道倒计时，分别为30,20,5秒，分情况：当主干道有车时，红黄绿交替，当只一个道路上有车时，那个道的交通灯变绿色，利用max+plus2做成，使用flex8000,epf8282alc84_4只用加一个38译码器模块即可，使用别的板子也可以运行 ...
压缩解压 哈夫曼编码译码系統
哈夫曼编码译码系統，利用哈夫曼编码进行信息通信可以大大提高信道利用率，缩短信息传输时间，降低传输成本。但是，这要求在发送端通过一个编码系统对待传数据预先编码，在接收端将传来的数据进行译码（复原）。对于双工信道（既可以双向传输信息的信道），每端都需要一个完整的编/译码系统。本次设计就是为这样的信息收发 ...
单片机开发 ZGL7289全套中文资料+实例 ZLG7289B是广州周立功单片机发展有限公司自行设计的
ZGL7289全套中文资料+实例
ZLG7289B是广州周立功单片机发展有限公司自行设计的，具有SPI串行接口功能的可同时驱动8位共阴式数码管(或64只独立LED)的智能显示驱动芯片，该芯片同时还可连接多达64键的键盘矩阵，单片即可完成LED显示﹑键盘接口的全部功能，该芯片经过了多年的验证，现正式转化为ASIC芯片，一次性流片成功，让 ...
可编程逻辑 高级FPGA教学实验指导书-逻辑设计
第一章、ALTERA QUATUSII 5.0 使用介绍...................................... 3
1. 概述.................................................................. 3
2. QUATUSII 设计过程..................................................... 5
2.1. 建立工程.......................................................... ...
电源技术 LLC串联谐振全桥变换器设计
LLC串联谐振全桥和移相全桥变换器工作原理的分析与设计。
应用设计 十六进制七段数码显示器的Verilog设计
学习7段数码显示译码器、十六进制计数器以及顶层连接模块的Verilog设计；
2、掌握组合逻辑，时序逻辑以及用例化语句实现顶层模块的Verilog设计方法；
3、熟悉QuartusⅡ的整个设计流程，仿真方法，引脚锁定，下载及测试方法。
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技术资料 300个C51单片机设计proteus仿真源码软件源码: 100000秒以内的计时程序 10秒的秒表
300个C51单片机设计proteus仿真源码软件源码:100000秒以内的计时程序10秒的秒表12864LCD图形滚动演示128X64LED160128LCD图文演示1602字符液晶滚动演示程序1602液晶显示的DS1302实时时钟16×16点阵(滚动显示)16×16点阵2(滚动显示)2io5键盘模拟音量数码管显示2×20串行字符液晶演示32x16汉字44行列键盘485全双工通信4×4键盘 ...