搜索：计数程序

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https://www.eeworm.com/dl/663/170195.html VHDL/FPGA/Verilog

24,60,100进制的计数器

24,60,100进制的计数器，还有数字时钟，欢迎下载哦~
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https://www.eeworm.com/dl/663/263837.html VHDL/FPGA/Verilog

vhdl实验 计数器：generate语句的应用

vhdl实验 计数器：generate语句的应用
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https://www.eeworm.com/dl/647/268458.html 嵌入式/单片机编程

该实验设计模60计数器

该实验设计模60计数器，并通过数码管进行显示，最后实现秒表的功能。7段数码管采用共阴极数码管，如图1所示，当某段接有高电平时该段将发光。
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https://www.eeworm.com/dl/663/270394.html VHDL/FPGA/Verilog

基于vhdl的6进制计数器模块

基于vhdl的6进制计数器模块，实现0-5计数
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https://www.eeworm.com/dl/663/270395.html VHDL/FPGA/Verilog

基于vhdl的10进制计数器模块

基于vhdl的10进制计数器模块，实现0-9计数
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https://www.eeworm.com/dl/663/272239.html VHDL/FPGA/Verilog

可自由配置的通用计数器

可自由配置的通用计数器，我设计的时候一直在用
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https://www.eeworm.com/dl/644/273466.html 汇编语言

将计数器0设置为方式0

将计数器0设置为方式0，计数器初值设为0H~FH，用手动逐个输入单脉冲，编成使计数值在屏幕上显示，并同时用逻辑笔观察OUT0点平变化。程序如下：
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https://www.eeworm.com/dl/663/290456.html VHDL/FPGA/Verilog

利用VHDL语言编写,在lcd上显示计数.

利用VHDL语言编写,在lcd上显示计数.
下载 169
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查看 1105
https://www.eeworm.com/dl/682/348885.html 中间件编程

基于CPLD的计数器 实现光纤测距

基于CPLD的计数器 实现光纤测距，包含与单片机的时序控制 Verilog 实现 通过仿真
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https://www.eeworm.com/dl/648/356423.html 单片机开发

利用单片机定时计数器

利用单片机定时计数器，测量信号频率： 利用单片机定时计数器，测量信号频率
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