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找到约 1,114 项符合
计数器 的查询结果
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并行计算 数字系统设计这是有关的相关源代码
数字系统设计这是有关的相关源代码，有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器 三人表决器（三种不同的描述方式） 加法器描述 8位总线收发器：74245 （注2） 地址译码（for m68008） 多路选择器（使 BR> ... ...
VHDL/FPGA/Verilog 如果不考虑占空比
如果不考虑占空比，直接利用计数器来进行分频，则占空比会发生变化。下面程序实现1：1的三分频。
matlab例程 ％ 文件名：randlsbget.m ％ 程序员:余波 ％ 编写时间:2007.6.25 ％ 函数功能: 本函数将完成提取隐秘于上的秘密信息 ％ 输入格式举例:result=( scover.
％ 文件名：randlsbget.m
％ 程序员:余波
％ 编写时间:2007.6.25
％ 函数功能: 本函数将完成提取隐秘于上的秘密信息
％ 输入格式举例:result=( scover.jpg ,56, secret.txt ,2001)
％ 参数说明:
％ output是信息隐藏后的图象
％ len_total是秘密信息的长度
％ goalfile是提取出的秘密信息文件
％ key是随机间隔函数的密钥
...
单片机开发 x5045有四种功能：分别是上电复位、看门狗定时器、电源电压监控和块锁保护串行eeprom的功能
x5045有四种功能：分别是上电复位、看门狗定时器、电源电压监控和块锁保护串行eeprom的功能，
该程序通过改变控制寄存器的参数可以实现看门狗定时器监视电压和设置保护rom区，每次复位后
地址计数器都是该区的首地址（个人观点），即断点地址。
问题：其实对该芯片的应用还是很模糊 ...
VHDL/FPGA/Verilog 光栅尺的四细分和辩向电路
光栅尺的四细分和辩向电路，并具有计数器功能，利用Quartus综合，可以参考
汇编语言 一、 使用键盘显示接口芯片8279接收按键键值
一、 使用键盘显示接口芯片8279接收按键键值，并在七段数码管上显示出来，通过判断键值进入相应音乐播放处理程序。在音乐播放程序中，使用定时器/计数器8253的计数器2，使其工作在方式&not &not 3—方波发生器，通过查表依次取出乐曲频率值送入计数器作为计数初值，经out2输出方波，驱动扬声器发出不同频率的声音，在每个音 ...
VHDL/FPGA/Verilog 在QuartusII运用ＡＨＤＬ语言
在QuartusII运用ＡＨＤＬ语言，首先设计出PN发生器来产生一个11位的数据流在整个周期内有效数据有 =2047位；再设计状态机用来检测串行数据流中的序列。运用两个个计数器分别对PN码计数以及序列出现的次数计数。改变ＰＮ码结构可以作为通用数列检测器 ...
单片机开发 /* 程序详细功能介绍： *当按下按键P3.3
/* 程序详细功能介绍：
*当按下按键P3.3 ，AT89S51单片机产生“叮咚”声从P3.2端口输出
*程序设计方法
* 1． 我们用单片机实定时/计数器T0来产生700HZ和500HZ的频率，根据定时/计数器T0，我们取定时250us，
* 因此，700HZ的频率要经过3次250us的定时，而500HZ的频率要经过4次250us的定时。
* 2． 在设计过程，只有当 ...
单片机开发 /* 程序详细功能介绍： * 用AT89S51单片机产生“嘀、嘀、…”报警声从P3.2端口输出
/* 程序详细功能介绍：
* 用AT89S51单片机产生“嘀、嘀、…”报警声从P3.2端口输出，产生频率为1KHz，
* 1KHZ方波从P3.2输出0.2秒，接着0.2秒从P3.2输出电平信号，如此循环下去，就形成我们所需的报警声了。
*
* 程序设计方法
*（1．生活中我们常常到各种各样的报警声，例如“嘀、嘀、…”就是常见的一种声音报警声， ...
VHDL/FPGA/Verilog 设计一个可编程间隔定时器
设计一个可编程间隔定时器，完成8253的功能，实现以下几点要求：
1、 含有3个独立的16位计数器，能够进行3个16位的独立计数。
2、 每一种计数器具有六种工作模式。
3、 能进行二进制/十进制减法计数。
4、 可作定时器或计数器。 ...