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脉冲计数 的查询结果
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数学计算 本程序研究在单个脉冲发现概率一定的条件下
本程序研究在单个脉冲发现概率一定的条件下,对目标辐射源发现概率随时间的变化。
%采用蒙特卡罗过程仿真方法;
VHDL/FPGA/Verilog 这是一个关于篮球24秒计数的Verilog程序
这是一个关于篮球24秒计数的Verilog程序,程序中包含了开始,暂停,复位键。
驱动编程 利用winio对ISA板卡进行驱动开发
利用winio对ISA板卡进行驱动开发,完成了脉冲的计数
Java编程 JSP操作文本文件进行网页访问量计数
JSP操作文本文件进行网页访问量计数,可以稍加思索把计数写进数据库
VHDL/FPGA/Verilog 能够实现小时(24进制)、分钟和秒钟(60进制)的计数功能 具有复位功能 功能扩展:具有整点报时提示、定时闹钟等功能
能够实现小时(24进制)、分钟和秒钟(60进制)的计数功能
具有复位功能
功能扩展:具有整点报时提示、定时闹钟等功能
文件格式 本文件时关于脉冲发生器的设计
本文件时关于脉冲发生器的设计
嵌入式/单片机编程 I2C程序函数是采用软件延时的方法产生SCL脉冲,对高晶振频率要作一定的修改 C%NG#A1e0(本例是3us机器周期,如果系统对时间要求不是很重要的话,最好在每个单元读写结束时加个延时
I2C程序函数是采用软件延时的方法产生SCL脉冲,对高晶振频率要作一定的修改
C%NG\#A1e0(本例是3us机器周期,如果系统对时间要求不是很重要的话,最好在每个单元读写结束时加个延时,
$`Z(Un+b0Tm0测试有子地址器件函数,未测试无地址的器件,适合器件地址和子地址小于256的器件, 大于256的单元的器件可以自己改写)。
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其他 用LSFR实现计数功能
用LSFR实现计数功能,可以减少对寄存器和少一个加法器,涉及verilog的人来说